赛灵思 Xilinx UG1414 - Vitis AI 用户指南（中文版） (v1.3)

最新推荐文章于 2025-10-08 09:06:18 发布
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本文档详细介绍了Xilinx的Vitis™AI SDK，它专为深度学习处理器设计，提供从下载链接到用户指南的全面教程，帮助开发者快速上手深度学习应用开发。
Vitis AI(03) Vivado Flow
abcxy2161的博客
05-26 1978
从本文开始，将正式介绍VitisAI的工作流程。第一个流程就是Vivado Flow，在Vivado开发环境中创建一个硬件平台，为后续的PetaLinux和Vitis提供基础。Vivado中的大部分的内容都是在Block Design中完成的，核心目标是创建一个Zynq UltraScale MPSoC的运行硬件环境，以及为DPU的正常运行提供硬件支持。这里需要注意，较老版本的VitisAI教程中，需要在Vivado中导入DPU的IP核，这种做法已经成为历史，本文介绍的流程中，在Vivado中是不需要导入D
赛灵思中文版技术文档资源汇总（持续更新）
weixin_45825101的博客
07-16 4887
本篇文章为赛灵思简体中文文档资源汇总帖，包含了版本说明、用户指南、产品指南、设计方法指南、数据手册、白皮书、应用指南和其他共八个板块，这八个板块是原Xilinx现AMD技术支持团队为方便中文用户的使用，对原版资源的进行的中文翻译，希望能对大家有所帮助。......
vitis-ai中文资料.pdf
08-02
中文手册方便入门过程中快速打通流程
上位机知识篇---Vitis AI
最新发布
道阻且长，行则将至。
10-08 1261
VitisAI是AMD推出的AI推理开发平台，可将主流AI框架训练的模型转换为能在FPGA等硬件上高效运行的格式。它包含模型优化、量化、编译等工具链，能大幅提升AI推理性能并降低功耗。VitisAI简化了AI模型在专用硬件的部署流程，使开发者无需深入硬件细节即可实现边缘计算场景下的高性能AI应用。通过量化技术、专用DPU处理器和优化工具，VitisAI在保持精度的同时显著提升推理速度，是边缘AI部署的理想解决方案。
xilinx User guide
03-14
xilinx 官方使用手册 可以用来学习verilog 里面还有很多推荐的实践
Vitis-AI-1.3-TensorFlow2 使用TensorFlow2 构建custom AI模型的流程；
oldmoney
04-26 816
Vitis-AI 1.3/TensorFlow2 环境下使用自定义 CNN 模型进行 Mnist 分类 本示例工程中我们会在 TensorFlow2 下使用 Keras API 创建一个自定义 CNN 网络，在 Vitis-AI 1.3 环境下编译成 Xilinx DPU 上运行的模型文件，并在 Xilinx zynqMP 上部署运行。 可从link的 github 页面获得源码 ...
Vitis AI学习笔记(1): Vitis AI 开发工具包概述
热门推荐
falwat的专栏
03-18 1万+
** 声明：文章翻译自UG1414 (v1.0) Vitis AI User Guide， 仅供学习参考。 ** 目录Vitis AI 开发工具包概述特点组件深度学习处理单元（DPU）AI Model ZooAI 优化器AI 量化器AI 编译器AI 分析器AI 库AI RuntimeFor 云计算For 边缘计算深度学习处理单元（DPU）DPU-V1 for CloudDPU-v2 for Edg......
Vitis-AI集成
吴建明wujianming_110117
12-23 1602
Vitis-AI集成 Vitis-AI是Xilinx的开发堆栈，用于在Xilinx平台（包括边端设备和Alveo卡）上进行硬件加速的AI推理。它由优化的IP，工具，库，模型和示例设计组成。设计时考虑到了高效率和易用性，充分发挥了Xilinx FPGA和ACAP上AI加速的全部潜力。 TVM内部当前的Vitis-AI Byoc流可加速边端和云端的神经网络模型推理。支持的边端和云端深度学习处理器单元（DPU）的算子分别是DPUCZDX8G和DPUCADX8G。DPUCZDX8G和DPUCADX8G是 分别 在X
ug908-Vivado Design Suite 用户指南烧录和调试-中文资料
10-30
同时，这份用户指南可能并不包含最新版英语文档的所有更新内容，因此对于需要获取最新信息的用户而言，官方建议用户查看最新版本的英语文档。 AMD公司坚持打造一个包容性的环境，从产品设计到宣传资料都在积极去除...
赛灵思-斯巴达6-FPGA-中文数据手册.pdf
06-26
赛灵思-斯巴达6系列FPGA是一种高性能的可编程逻辑器件，被广泛应用于多种领域。本手册提供了该系列FPGA的电气特性和功能规格，以帮助设计者在进行系统设计时能够全面了解该芯片的特性。手册中提到的产品型号包括多个...
XC7VX690T-2FFG1158I 赛灵思 Xilinx FPGA Virtex-7 7V
2403_90082736的博客
03-11 2070
XC7VX690T-2FFG1158I 赛灵思 Xilinx FPGA Virtex-7 VX690T。
赛灵思Zynq-7000片上系统（SoC）- 中文数据手册.pdf
06-16
赛灵思Zynq-7000系列片上系统（SoC）是一系列集成了处理器和可编程逻辑的集成电路。本数据手册主要介绍了Zynq-7000系列中的Z-7030、Z-7035、Z-7045以及Z-7100这几款产品的直流（DC）和交流（AC）开关特性，包括产品...
开始使用Vitis软件工具.pdf
03-21
开始使用Vitis软件工具，主要是关于xilinx新软件vitis的一些简单看法，没有啥新的内容，这些内容从官网中也能看到。
xilinx vitis ai使用方法
05-20
xilinx vitis AI工具介绍 安装方法 算法部署
Xilinx Vivado User Guides 赛灵思Vivado软件使用手册合集
06-13
包含Xilinx 官方全部Vivado软件的用户指导手册，详细介绍了Vivado环境下FPGA使用和设置。
赛灵思7系列手册
12-13
这包含了赛灵思7系列所有产品的简介，对于用户选型有很大的帮助
XC6SLX100T-2FGG484I 赛灵思 XilinxFPGA Spartan-6
2403_90082736的博客
04-17 745
XC6SLX100T‑2FGG484I 集成 4 条 GTP 高速串行收发器，速率可达 3.2 Gb/s，支持 Serial ATA、Aurora、1 GbE、PCI Express、CPRI、DisplayPort、XAUI 等多种协议，满足高速数据链路需求。Spartan‑6 提供混合时钟管理单元（CMT），每个 CMT 包含 2 个 DCM 和 1 个 PLL，支持倍频、分频、相位对齐和抖动清除，可驱动内部逻辑和 I/O 时钟，实现多时钟域设计与高精度时序控制。
赛灵思的block memory generator用户手册pg058翻译和学习（AXI4 Interface Block Memory Generator Feature Summary）
danxutj的博客
02-26 1856
AXI4 Interface Block Memory Generator Feature Summary AXI4接口BMG功能概述
Vitis AI 综合实践（迁移学习+模型量化+DPU部署）
hi94的博客
04-19 3079
本文主要介绍使用Vitis AI工具创建自定义的Xmodol，难点并不在工具本身，而是需要了解很多机器学习的知识。一个很好的出发点是使用Vitis Model Zoo库，是一个包含了大量预训练模型的资源库，这些模型涵盖了多种AI应用领域，如图像分类、目标检测、语义分割、人脸识别、自然语言处理等。
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