玩转Zynq连载4——AXI总线协议介绍2

本文是Zynq系列教程的一部分,详细介绍了AXI总线协议的各个通道信号,包括写地址、写数据、写响应、读地址和读数据通道,阐述了信号的作用和握手过程,有助于理解Zynq中数据传输的机制。

玩转Zynq连载4——AXI总线协议介绍2

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2 信号描述
2.1 全局信号
表2-1 全局信号
信号 来源 描述
ACLK 时钟源 全局时钟信号。所有的信号都在全局时钟的上升沿采样。
ARESETn 复位源 全局复位信号。低电平有效。

2.2 写地址通道信号
表2-2 写地址通道信号
信号 来源 描述
AWID[3:0] 主机 写地址ID。这个信号是写地址信号的唯一标识。
AWADDR[31:0] 主机 写地址。写地址总线为突发写传输的第一个有效数据传输提供地址。相关控制信号决定了后续传输的有效数据相对于第一个地址的关系。
AWLEN[3:0] 主机 突发长度。突发长度提供突发传输的数据长度。
AWSIZE[2:0] 主机 突发位宽。突发位宽提供突发传输中每个有效数据的位宽。
AWBURST[1:0] 主机 突发类型。突发类型伴随着位宽信息。
AWLOCK[1:0] 主机 锁定类型。
AWCACHE[3:0] 主机 缓存类型。
AWPROT[2:0] 主机 保护类型。
AWVALID 主机 写地址有效。这个信号指示此时传输的是有效的写地址和控制信息:1 = 地址和控制信息是有效的;0 = 地址和控制信息无效。地址和控制信息保持稳定直到地址响应信号AWREADY为高电平。
AWREADY 从机 写地址准备好。这个信

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