本文是一份关于模型机设计的报告，目标是设计一个简易CPU，涵盖了从整体架构到各个模块如PC计数器、选择器、RAM、通用寄存器组、ALU、移位逻辑、指令寄存器、指令译码器的详细设计。报告还涉及了测试环境，包括FPGA型号EP1C3T144C8的特性，以及CPU的性能分析和设计总结，强调了一些设计中的注意事项。
模型机设计报告
一、设计目的
设计一个简易CPU。完整、连贯地运用《数字逻辑》所学到的知识，熟练掌握 EDA 工具基本使用方法，为学习好后续《计算机原理》课程做铺垫。（来自实验指导书）
二、设计内容
① 按照给定的数据通路、数据格式和指令系统，使用 EDA 工具设计一台用硬连线逻 辑控制的简易计算机； ② 要求灵活运用各方面知识，使得所设计的计算机具有较佳的性能； ③ 对所设计计算机的性能指标进行分析，整理出设计报告。
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三、详细设计
- 3.1整体架构
- 3.2各个模块实现
（此部分必须有模块的接口设计，功能实现，功能的仿真验证等内容。）
1.时钟节拍
SZJP
取址阶段和执行阶段中，有些元件是高阻态，有些元件是低阻态，所以应该一共应该有四个时钟控制。取址阶段clk1和clk2，执行阶段clk3和clk4。
2.PC计数器
PCJSQ
PC计数器的作用是提供一个取指令的地址，需要支持自加一(顺序计数)和加载总线上数据(跳转)这两个功能。
引脚说明：
CLK ：时钟信号，时钟信号到来时配合LDPC和INPC控制PC计数器的操作；
LDPC：控制PC计数器是否进行计数操作，高电平有效；
INPC：控制PC计数器进行加一操作还是加载BUS总线上的数据，当LDPC为高电平时，INPC为
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