7series 逻辑单元理解（更新中）

最新推荐文章于 2024-04-20 19:21:00 发布

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原文链接：http://www.cnblogs.com/limanjihe/p/9781676.html

本文深入解析了Xilinx 7series FPGA中的关键逻辑单元，包括IOBUF、FDPE、FDCE、FDRE、FDSE的功能特性及应用场景，以及BUFG、BUFR、BUFIO等时钟缓冲器的作用范围。通过对比不同单元的异同，帮助读者理解其在复位电路、时钟域处理中的应用。

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7series 逻辑单元理解

ug768和ug799文档介绍了7系列芯片中包含的基本逻辑单元，对其中常用的单元，进行下分析。

1、IOBUF单元

（1）真值表

（2）用途

the design element is a bidirectional single-ended I/O Buffer used to connect internal logic to an external bidirectional pin.

（3）属性

（4）模型

（5）心得体会

IOBUF作为FPGA内部逻辑与外部逻辑的接口，通常被打包成多bit进行使用；与CPLD一样，可以直接使用assign out = sel ? internal : 'dZ ，编译器综合成此模块。

2、FDPE单元

（1）真值表

（2）用途

（3）属性

（4）模型

。

（5）心得体会

FDPE作为带有异步预置位的DFF，一般用作复位电路中，可以作为MMCM中不同时钟域中复位的输出。参看《Xilinx FPGA复位逻辑处理小结》

3、FDCE/FDPE/FDRE/FDSE区别：

	FDCE	FDPE	FDRE	FDSE
名称含义	C：asynchronous clear	P: asynchronous preset	R: synchronous reset	S: synchronous set
时钟域	异步	异步	同步	同步
常见用途	always@(posedge clk or posedge rst )	作为跨时钟域复位处理单元
init属性作用	set the initial value of Q output after configuration，指的是配置好FPGA逻辑后的Q初值。
符号