makefile中一些符号

最新推荐文章于 2023-03-26 15:13:31 发布
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a.o : b.c c.c
$?所有比目标新的依赖目标的集合
$^代表所有依赖文件（b.c, c.c）
$@代表规则的目标文件（a.o）
$<代表第一个依赖文件（b.c）
[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[[
在u-boot的makefile中，有这样里两段
smdk2410_config : unconfig
@$(MKCONFIG) $(@:_config=) arm arm920t smdk2410 NULL s3c24x0

第一个@是让编译时不显示这条命令。。。

第二个@并不是单独的，而是和$一起构成$@，表示目标（注意是整个目标，包括扩展名的），在这里的意思就是smdk2410_config ，s:a=b的意思是把s中的a用b替换， 
这样就很清楚了，$(@:_config=)等价于（smdk2410_config:_config=)，是要把smdk2410_config转变为smdk2410

wangmingape
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【工程化系列】makefile中“-“符号和“@“符号的使用
优快云明星博主，认证博客专家，视频、Matlab领域优质创作者。
02-08 1382
DATE: 2020.2.8 1、参考 2、makefile中“-”符号的使用 3、makefile中“@”符号的使用
Makefile中如何使用echo输出$符号
wwwyuewww的专栏
02-29 1710
简单总结一下，makefile中可以使用两个$来表示$本身，而shell中需要使用反斜杠/来转义$符号。
MakeFIle $@,$^,$<
weixin_34277853的博客
08-04 163
Makefile  $@, $^, $&lt; $@  表示目标文件$^  表示所有的依赖文件$&lt;  表示第一个依赖文件$?  表示比目标还要新的依赖文件列表
Makefile各类符号
邢啦　为软件事业尽一份力
12-23 1824
makefile总规则：欲更新目标，必须首先更新它的所有条件； 命令列表中的每条命令必须以一个Tab开头，注意不能是空格，Makefile的格式不像C语言的缩进那么随意，对于Makefile中的每个以Tab开头的命令，make会创建一个Shell进程去执行它, 在大型项目中gcc的-M选项自动生成目标文件和源文件的依赖关系冒号表示，main: main.o stack.o maze.o
Makefile常见符号意思
qq_37659294的博客
06-19 2481
Makefile里有许许多多的符号，对于新手而言如果没有经常使用，就很容易忘记，所以我把常见符号的意义写下，方便日后忘记查询。本文章会持续更新... 1.$@：代表目标；$^代表所有依赖，$^代表第一个依赖。 eg：下图的$@代表目标名test，$^代表所有依赖，即test.c和seqlist.c，所以相当于gcc -O0 -g -Wall -o test te...
Makefile符号介绍
weixin_45087979的博客
07-11 664
用在规则行，表示不显示命令本身，只产生结果。扩展打开makefile定义的变量。代表目标文件(target)
Makefile之特殊符号
sh的博客
01-20 622
$@                    --代表目标文件(target) $^                     --代表所有的依赖文件(components) $ @{+order}        --不显示命令本身，只显示命令执行结果。 - + order         --表示遇到错误，不中断执行，将继续make
makefile 中赋值符号的区别
08-04
在Makefile中，赋值符号的选择对于规则的执行和变量的定义至关重要。下面将详细解释 `=`、`:=`、`?=` 和 `+=` 这四种赋值运算符的区别。 1. `=`（延迟赋值） 这个是最基础的赋值操作符。使用 `=` 进行赋值时，...
GNU-Makefile中文手册-Ver3.8.pdf
05-27
- **指定变量**：用户可以在Makefile中定义变量，简化重复的文本。 - **自动推导规则**：make内置了隐含规则，可以自动推断如何处理某些类型的文件。 - **另类风格的Makefile**：除了标准格式，还有其他风格的...
工程Makefile中常用符号
weixin_38697824的博客
12-26 1392
Makefile中常见内容 TOPDIR := $(shell /bin/pwd) CONFIG_SHELL := $(shell if [ -x "$$BASH" ]; then echo $$BASH; \ else if [ -x /bin/bash ]; then echo /bin/bash; \ else echo sh; fi ...
Makefile中的一些符号介绍
永远
12-31 3956
1. Makefile中:=，=，?=和+= “=”是最普通的等号，在Makefile中也是最容易搞错的赋值等号，使用“=”进行赋值，变量的值是整个makefile中最后被指定的值。 举例如下： x = A y = $(x) B x = AA 经过上面的赋值后，最后y的值是AA B，而不是A B。make会将整个makefile展开后，再决定变量的值。也就是说，变量的值将会是整个ma...
Makefile的编写及四个特殊符号的意义@、$@、$^、$
diedai7174的博客
07-08 1025
https://www.cnblogs.com/sky-heaven/p/9450435.html Makefile一般的格式是： target:components rule 一、@ 这个符...
MakeFile基本符号简单解读
人道酬心的博客
12-15 333
main：main.o mytool1.o mytool2.o gcc -o $@ $^ ..c.o：      gcc -c $ @--目标文件,$^--所有的依赖文件,$  这个规则表示所有的 .o 文件都是依赖与相应的.c 文件的.例如mytool.o 依赖于mytool.c
Makefile第七课：Makefile常用符号
周同学的博客
03-26 456
Makefile第七课笔记
Makefile中常用的一些符号
OneSea的专栏
07-24 6731
1 编译器 CC // C语言编译器，默认值为gcc CXX // C++语言编译器，默认值为g++ 说明：这是默认的变量，无需用户自定义（但是用户可以修改其值，例如CC=arm-linux-gcc，用于交叉编译）。
学习日志----Makefile常用符号，通用Makefile
a1240553493的博客
08-20 712
本文章主要来自韦东山老师的B站视频，《嵌入式linux应用开发手册》 B站视频：https://www.bilibili.com/video/BV1kk4y117Tu?p=5 makefile主要用来编译程序的，在大型工程里用的很多。 在现在这个阶段，我对自己的要求就是：能大概看懂，会使用通用Makefile，为了以后翻阅，在此记录一些知识点。 更详细的Makefile，可以看《Gnu make》，《Gnu make》翻译版于凤昌 看懂Makefile 1makefile核心规则 目标(target)
最基本的makefile三（一些特殊符号的使用）
小吕的博客
06-04 430
1、用一个其他东西代替gcc <cc = gcc>或许你有时候会有许多gcc要改g++会很麻烦用这种类似与全局变量的东西会很简单 CC = gcc main:main.c tool.o bar.o $(CC) main.c tool.o bar.o -o main tool.o:tool.c $(CC) -c tool.c bar.o:bar.c $(CC) -c bar.c clean: rm main rm *.o 2、需要另外一些编译条件时 CC = gcc FLAG
2012-04-23 21:24 Makefile常用函数集
流水
03-21 731
$(subst ,,)     名称：字符串替换函数——subst。     功能：把字串中的字符串替换成。     返回：函数返回被替换过后的字符串。     示例：                $(subst ee,EE,feet on the street)，                把“feet on the street”中的“ee”替换成“EE”，返
在makefile中定义逗号字符串和空格字符串
几罗星人的专栏
02-26 5174
空格和逗号是makefile中常见的分隔符，估计是写不出一个完全没有空格和逗号的makefile的，没有的话意义就不对了。但是如果要进行字符串处理，空格和逗号就不能直接出现了，即使直接写上make解析器也不会将其作为字符串使用。所以应该这样写，才能让空格和逗号变成字符串。具体是谁想出来的已经不可考了，这里就写原创，请真正的原创不要见怪。 comma:=, empty:= space:=$(emp
给出makefile中的所有符号
最新发布
08-13
### Makefile 中的符号及其作用 Makefile 是 GNU `make` 工具解析的构建脚本，用于控制编译流程。其语法中使用了多种符号来表示变量、规则、依赖关系等。以下是对 Makefile 中常见符号的详细说明。 --- #### 1. **`:`（冒号）** 表示规则中的目标与依赖之间的分隔符。左侧是目标，右侧是依赖文件列表。 ```makefile main.o: main.c defs.h cc -c main.c ``` 此语法定义了 `main.o` 的生成规则，依赖于 `main.c` 和 `defs.h` [^5]。 --- #### 2. **`=`（赋值符）** 用于定义变量并赋值，是基本的变量赋值方式。 ```makefile objects = main.o kbd.o command.o ``` 该语句定义了变量 `objects` 并赋值为目标文件列表 [^5]。 --- #### 3. **`:=`（立即展开赋值符）** 定义变量时立即展开右边的表达式，而不是延迟展开。 ```makefile x := foo y := $(x) bar ``` 此时 `y` 的值为 `foo bar`，因为 `$(x)` 在赋值时已经展开 [^1]。 --- #### 4. **`?=`（条件赋值符）** 只有在变量未定义时才赋值。 ```makefile FOO ?= bar ``` 如果 `FOO` 尚未定义，则其值为 `bar`；否则保持原值 [^1]。 --- #### 5. **`+=`（追加赋值符）** 向已有变量追加值。 ```makefile CFLAGS += -Wall ``` 将 `-Wall` 添加到 `CFLAGS` 变量中 [^1]。 --- #### 6. **`$`（变量引用符）** 用于引用变量的值，通常与括号或花括号一起使用。 ```makefile cc -o edit $(objects) ``` `$(objects)` 表示引用变量 `objects` 的值 [^5]。 --- #### 7. **`@`（命令前缀）** 在命令前加上 `@` 可以阻止该命令在执行时被输出。 ```makefile @echo "Compiling..." ``` 运行时不会显示 `echo "Compiling..."`，只显示输出结果 [^1]。 --- #### 8. **`-`（忽略错误前缀）** 在命令前加 `-` 表示忽略该命令的执行错误。 ```makefile -rm *.o ``` 即使 `rm` 命令失败（如文件不存在），也不会中断 `make` 的执行 。 --- #### 9. **`+`（强制执行前缀）** 在命令前加 `+` 表示即使使用 `-n` 选项，该命令也会被执行。 ```makefile +echo "This will run even with -n" ``` --- #### 10. **`#`（注释符）** 用于在 Makefile 中添加注释，从 `#` 开始到行尾的内容将被忽略。 ```makefile # This is a comment CC = gcc ``` --- #### 11. **`\`（续行符）** 用于将一行内容延续到下一行，避免单行过长。 ```makefile objects = main.o kbd.o command.o \ display.o insert.o search.o ``` --- #### 12. **`%`（通配符）** 用于模式规则中，匹配任意非空字符串。 ```makefile %.o: %.c $(CC) -c $< ``` 该规则表示所有 `.o` 文件都依赖于同名的 `.c` 文件 [^5]。 --- #### 13. **`$@`（自动变量）** 表示规则中的目标文件名。 ```makefile edit: $(objects) cc -o $@ $(objects) ``` `$@` 等价于 `edit` [^5]。 --- #### 14. **`$<`（自动变量）** 表示第一个依赖文件。 ```makefile %.o: %.c $(CC) -c $< -o $@ ``` `$<` 表示 `.c` 文件 。 --- #### 15. **`$^`（自动变量）** 表示所有依赖文件列表，去重。 ```makefile edit: main.o kbd.o cc -o $@ $^ ``` `$^` 等价于 `main.o kbd.o` [^5]。 --- #### 16. **`vpath`（关键字）** 用于指定搜索路径，支持模式匹配。 ```makefile vpath %.c src/ ``` 表示在 `src/` 目录下查找 `.c` 文件 [^3]。 --- #### 17. **`VPATH`（变量）** 指定所有依赖文件的搜索路径。 ```makefile VPATH = src:include ``` 表示在 `src` 和 `include` 目录中查找依赖文件 [^3]。 --- #### 18. **`.PHONY`（伪目标）** 声明一个目标为伪目标，即使存在同名文件也不会跳过执行。 ```makefile .PHONY: clean clean: rm *.o ``` 如果没有声明 `.PHONY`，而当前目录存在 `clean` 文件，则 `make clean` 不会执行 [^4]。 --- #### 19. **`include`（关键字）** 用于在 Makefile 中包含其他 Makefile 文件。 ```makefile include config.mk ``` 可以将 `config.mk` 中的变量和规则包含进当前 Makefile [^1]。 --- #### 20. **`-I`（命令行选项）** 指定包含其他 Makefile 文件的搜索路径。 ```bash make -I includes/ ``` 表示在 `includes/` 目录中查找被 `include` 引用的文件 [^1]。 --- ###
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