Allegro PCB差分对的设置以及对差分对的驱动

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本文介绍了如何在PCB设计中设置差分对，包括在logic面板中定义差分线，创建差分对类，并在PhysicalConstraintSet中设定100欧姆阻抗的差分规则，如线宽、间距等参数。最后，讲解了如何为创建的差分对设置驱动规则，确保信号完整性的关键步骤。

差分对是指定：
在PCB页面上方的面板中点击logic设置差分对，如下图所示：
图一
进入下图页面后，直接点击一对差分线的两个引脚的网络，然后点击Add
图二
上述差分线设置后并没有对其进行驱动；
打开规则管理器中的All Layers，选中所有的差分对，右键创建类
图三
类名创建还没有指定差分规则，进入Physical Constraint Set中的All Layers，右键创建差分规则（例如阻抗为100欧姆，设置规则名为DIFF100，其中的线宽为6mil，差分对的间距为8mil，这些参数是通过阻抗计算工具SI9000计算出来的100欧姆阻抗对应的设置）
图四
上图中的规则创建后，给创建的差分对进行驱动
图五

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allegro 设置差分对
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<think>我们参考了用户提供的引用内容，这些引用描述了在Allegro软件中设置差分对的方法。用户的问题是如何在Allegro中设置差分对。根据引用内容，我们可以总结出两种主要方法：一种是在原理图中设置，另一种是在PCB设计环境中设置。同时，我们还注意到有自动生成差分对的方法（引用[4]）以及差分等长约束的设置（引用[1]）。 根据上述引用，我们整理出以下步骤： 方法一：在原理图编辑器中设置差分对（引用[1]） 步骤： 1. 打开Cadence原理图编辑器，打开需要编辑的原理图。 2. 选择“Tools”菜单中的“Create Differential Pair”选项。 3. 在弹出的对话框中，从Net属性下拉列表中选择要设置的信号线（通常选择正负两条线），通过双击或点击右侧的右移按钮将它们添加到右侧列表中。 4. 在“Diff Pair Name”属性框中填写自定义名称。 5. 点击“Create”按钮创建差分对。 6. 完成后点击“Close”按钮。 方法二：在Allegro PCB设计环境中手动创建差分对（引用[1][3]） 步骤： 1. 打开.brd文件。 2. 菜单栏点击Setup -> Constraints -> Electrical，打开约束管理器（Constraint Manager）。 3. 在约束管理器中，选择Electrical工作表下的Net->Routing->Differential Pair（引用[1]）或者也可以按照引用[3]的方法：选择Physical工作表->Net->All Layers，然后按住Ctrl键选择两个网络，右键点击选择Create->Differential Pair。 4. 在弹出的对话框中为差分对命名，然后关闭对话框。 方法三：在Allegro PCB设计环境中自动创建差分对（引用[4]） 步骤： 1. 在Allegro PCB设计环境中，选择菜单栏的Logic -> Assign Differential Pair -> Auto Generate。 2. 在弹出的对话框中，根据差分对网络名的命名规则（例如，以P/N结尾或以+/-结尾），输入相应的后缀（例如，在Positive Suffix中输入P，在Negative Suffix中输入N）。 3. 点击Generate按钮，系统会自动识别并生成差分对。 此外，在设置完差分对后，还需要为差分对设置约束规则（如差分线宽、线间距等），并将约束规则应用到差分对上（引用[2]）： 1. 在约束管理器中，选择Electrical工作表下的Net->Routing->Wiring。 2. 在右侧的列表中，找到你创建的差分对（通常在Differential Pair下）。 3. 在Referenced Electrical CSet列中，选择之前创建好的差分信号约束规则（如DIFF_DQS）。 另外，用户还提到了差分等长设置（引用[1]）： 组内等长（即差分对内部两根线的长度匹配）： 在约束管理器中选择Electrical->Net->Differential Pair，在Static Phase中设置Tolerance（容忍误差范围）。 组间等长（多个差分对之间的长度匹配）： 在约束管理器中选择Electrical->Net->Relative Propagation Delay，创建一个Match Group，将需要等长的差分对加入该组，并设置目标长度和公差。 因此，我们可以将回答分为两部分：差分对的创建和差分对约束规则的设置。 注意：由于引用[5]的内容与设置方法无关，我们忽略。 下面我们将按照用户要求，使用中文回答，生成相关问题，并正确使用LaTeX格式（尽管本问题涉及的是软件操作，数学公式较少，但如果有数学表达式则按规则处理）。 </think>在Allegro软件中设置差分对主要有以下几种方法，根据操作环境可分为原理图编辑器和PCB设计环境两种场景： ### 一、原理图编辑器设置方法（引用[1][4]） 1. **打开原理图** 启动Cadence原理图编辑器，载入目标原理图文件。 2. **创建差分对** - 选择菜单栏 `Tools` → `Create Differential Pair` - 在弹出窗口中： - `Net属性`下拉列表选择信号线（如CLK_P/CLK_N） - 双击或点击右移按钮添加到右侧 - `Diff Pair Name`输入自定义名称（如DIFF_CLK） - 点击 `Create` → `Close` 完成 ```mermaid graph LR A[Tools菜单] --> B[Create Differential Pair] B --> C{Net列表选择} C --> D[填写差分对名称] D --> E[Create] ``` ### 二、PCB设计环境设置方法 #### ▸ 手动创建（引用[1][3]） 1. **打开约束管理器** `Setup` → `Constraints` → `Electrical` → `Net` → `Routing` → `Wiring` 2. **创建差分对** - 右键目标网络 → `Create` → `Differential Pair` - 按住Ctrl选择正负线（如DDR_D0_P/DDR_D0_N） - 命名后点击 `OK` #### ▸ 自动创建（引用[4]） 1. **批量生成** `Logic` → `Assign Differential Pair` → `Auto Generate` - 输入网络名后缀（如正线用`P`/负线用`N`） - 点击 `Generate` 自动配对所有符合规则的网络 ### 三、差分规则设置（引用[1][2]） 完成创建后需配置约束规则： ```mermaid flowchart TB S[约束管理器] --> E[Electrical Net] E --> D[Differential Pair] D --> T[Static Phase] T --> Tol[设置Tolerance<br>组内长度容差] E --> R[Relative Propagation Delay] R --> MG[创建Match Group<br>设置组间等长] ``` 1. **组内等长** 在 `Differential Pair` 设置 `Static Phase` 的 `Tolerance` 值（误差容忍范围） 2. **组间等长** 在 `Relative Propagation Delay` 中： - 创建 `Match Group` 添加多个差分对 - 调整线长使 `SPhase`（组内）和 `RDly`（组间）进度条均变绿 > **关键指标说明**（引用[1]） > - `Actual`：实际长度误差值 > - `Margin = Tolerance - Actual`：剩余误差裕量 > 当$ \text{Margin} \geq 0 $时满足约束要求 ### 四、应用约束规则（引用[2]） 1. 在 `Electrical` → `Net` → `Routing` 工作表 2. 选中差分对 → `Referenced Electrical CSet` 3. 选择预设规则（如 `DIFF_DQS`）
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