Xilinx FPGA MPSOC ZU4EV的HDMI 4K60 H265编码（一）Vivado工程建立

原创 已于 2024-06-12 07:33:21 修改 · 1.2k 阅读 · 5 ·
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于 2024-03-31 12:19:08 首次发布
0、简介

        Xilinx的MPSOC EV系列，带有一个H264/H265编码硬核最大分辨率支持到8K30，其中4EV的性价比相对高，ZU402支持HDMI 4K60的最大输入输出，下面我们用ZU402开发板，建立一个最简单的编码工程。

ZU402开发板接口如下：

1、HMDI 4K@60视频采集框图

1.1.Vivado的BockDesign

把zu402_hdmirx_vivado.7z解压，打开HDMI编码工程zu402_hdmirx.xpr

要注意，在windows下，最好就是放在根目录，不要放太深的路径，要不编译会报错

1.1.HDMI采集部分BockDesign

1.2.VCU部分BockDesign

2、编译，直接点击Generate Bitstream编译工程

3、生成XSA硬件描述文件，给Petalinux工程用

第二章内容：基于MPSOC ZU4EV的HDMI 4K60 H265编码（二）Petalinux编译及上板运行-优快云博客

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Xilinx FPGA MPSOC ZU4EV的HDMI 4K60 H265编码（二）Petalinux编译及上板运行
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这节，我们就利用这个文件，生成固件，并在板子上跑HDMI输入视频的H265编码结果。注：其中BSP文件，要找相应开发板的供应商提供，在附件，我会提供一个ZU402的开发板BSP供大家参考。这篇文章介绍Petalinux部分的编译，及在ZU402上HDMI输入，H265编码的实现。8、把生成 的boot.scr BOOT.BIN image.ub复制到TF卡。2、把第一步生成 的xsa文件，复制到刚创建的工程目录内，如下图所示。9、把TF卡插到开发板，拔码拔到SD 卡启动方式 ，启动。
Xilinx ZYNQ 7000 HDMI
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xilinx 的hdmi core 接收端调试成功。
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本来发送端调好之后，接收端就应该很快调试成功。后来 调试了好久，一直抓不到数据。不停地调试寄存器。都没有输出。            后来发现最坑的一件事情，就是 输入的管脚配置跟着输出变。导致 没有数据。坑爹万分。泪奔。。。。。             后来把管脚重新配置，就OK了。 1920 x 1080 @60hz 和  3840 x 2160 @60hz 都可以很好地输出数据。
Xilinx FPGA MPSOC ZU402 的HDMI 4K@60 H265解码输出（一）HDMI 输出Vivado工程
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