smart3250 LCDDCLK设置为50MHz

最新推荐文章于 2022-10-24 11:18:54 发布
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首先:

  LCDPanelList.optimal_clock=50 000 000  编译后 串口打印的信息为:

 LCD: lcd_update_clock: Base clock 104000000, divider 3, LCD clock 34666666

用示波器实际测量为17.2MHz,与设定相差较大

问题在哪里?

查找芯片手册看到,与分频有关的寄存器为 PCD_HI PCD_LO

#define CLCDC_LCDTIMING2_BCD  0x04000000

 

 

sdzhangy
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