本文介绍了一个使用Makefile进行项目构建的例子。通过定义变量和规则，实现源文件到可执行文件的自动化编译过程。该Makefile支持指定编译器、编译标志、目标文件路径等配置，并提供清理编译产物的功能。
PROJECT=abc
MYLIB=
SYSLIB=
CFLAG=-g
CC=gcc
GCC=gcc
OBJDIR=./obj
SRCS=$(wildcard *.cpp)
OBJS=$(patsubst %.cpp,$(OBJDIR)/.o,$(SRCS))
$(PROJECT):$(OBJS)
$(GCC) -o $@ $^ $(CFLAG) $(SYSLIB) $(MYLIB)
$(OBJDIR)/%.o:%.cpp
$(GCC) -c -o $@ $<
clean:
rm -f $(OBJDIR)/*.o $(PROJECT)
MYLIB=
SYSLIB=
CFLAG=-g
CC=gcc
GCC=gcc
OBJDIR=./obj
SRCS=$(wildcard *.cpp)
OBJS=$(patsubst %.cpp,$(OBJDIR)/.o,$(SRCS))
$(PROJECT):$(OBJS)
$(GCC) -o $@ $^ $(CFLAG) $(SYSLIB) $(MYLIB)
$(OBJDIR)/%.o:%.cpp
$(GCC) -c -o $@ $<
clean:
rm -f $(OBJDIR)/*.o $(PROJECT)
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