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原创 论 run_phase和main_phase之间的缠绵

这是否定的,虽然说run_phase和12个动态运行的phase是并行执行的,但是,是和12个动态运行的phase,而不是单独的一个main_phase,上面提到过,如果要运行main_phase,那么至少需要在一个main_phase里面提起和放下objection才会运行,换句话如果是在run_phase里面提起和放下objection那么仿真结束就只由run_phase去决定。今天主要是为了解决 run_phase 和main_phase之间的执行顺序问题,以及很关键的objection机制。

2024-11-28 11:25:22 1119

原创 论 sv中$cast() 和 virtual 方法的用法

解释sverilog中的$cast()和virtual的部分用法

2024-11-22 16:56:18 1156 1

原创 关于m_sequencer 和 p_sequencer的个人理解

UVM

2024-10-27 13:49:44 973

原创 Systemverilog 实操记录分享 之 队列的使用

队列可以用任意类型定义,例如整数类型、结构体类型等。结束,如果记录的有什么不对的,请指正,还有就是记录的就顾自己看懂了,有的就很草率,我也想把遇到的问题分享出来,大家有相似问题可以解决。所以有什么建议都可以留言......

2024-06-24 20:23:30 4143

原创 Systemverilog 实操记录分享 之 数组的使用。

描述的不够清晰准确,但是能在代码和仿真的结果里面表达我想要叙述的,以及我当时存在的疑惑,首先是记录,然后才是分享,希望可以解决由于相同问题而困扰的学习人。

2024-06-22 13:42:50 1468

原创 Systemverilog中的打包和解包(流操作)

解密 SV中的流操作

2024-06-20 22:12:34 1775

空空如也

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