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RSS订阅原创 ERROR (PA2078) : Invalid PFD frequency ‘FCLKIN/IDIV_SEL‘ to ‘PLLA_inst‘(PLL) set by module ‘Gowin_P
询问高云FAE后发现是IP核及高云EDA版本的关系，由于开发软件升级的原因导致原始生成好的IP核在新版本上使用出错，博主目前使用的是最新版的V1.9.12（2025.11.19）查看PLL，输入的125MHz确实超过了这里报错信息说的87.5MHz。使用高云FPGA云源软件的。报错的内容是说输入频率 (
2025-11-19 16:15:33
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原创 ERROR (RP0007) : There is no SSRAM resource in current device, please use user assignment to change
在Configuration-Place&Route-General里把Convert。Configuration-General-Enable DSRAM的。SSRAM资源使用超出容量了，有一种可能的原因是。这个报错在另外一位博主的文章中有提到。使能，就可以正常综合通过了。ram，能够解决这个问题。
2025-11-13 21:04:13
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原创 高云FPGA云源软件生成IP核时报错：IP Core generation process occured errors GowinSynthesis occurs error.
GowinSynthesis occurs error
2025-03-17 15:14:08
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原创 【FPGA】基于IIC协议实现FPGA对EEPROM（24LC04B）的读写控制【附源码】
24LC04B是一种4kbit（2*256*8）容量的电可擦除PROM，该设备有两个256 x 8bit的存储块，具有2线串行接口（兼容IIC），支持最多写入16字节数据的页写功能， 兼容100kHz和400kHz的时钟速率，有16字节的页面写入缓冲区。
2024-09-13 00:10:37
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原创 ERROR (EX0311) : Invalid VCO frequency “(FCLKIN*(FBDIV_SEL+1)*ODIV_SEL)/(IDIV_SEL+1)“ to instance “r
ERROR (EX0311) : Invalid VCO frequency "(FCLKIN(FBDIV_SEL+1)*ODIV_SEL)/(IDIV_SEL+1)" to instance "rpll_inst", suitable range is from 500MHz to 1250MHz("D:\GaoYun\...PLL_4M.v":39)
2024-09-13 00:05:10
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原创 高云FPGA云源软件报错ERROR (EX3863) : Syntax error near ‘{‘(“...“)
使用Gowin时遇到了一下报错的提示：定位到括号里面的语句：首先根据错误代码的数字查看用户消息帮助文档：官方手册给出的建议是添加分号，但是这条语句末尾已有分号，再考虑这句话用的语法enum：查看Verilog标准语法时发现在Verilog中没有提到对enum的描述：在systemverilog中才有enum的解释:推测这里使用的是systemverilog的语法导致Verilog的编译环境不兼容了，查看综合的配置：目前选用的是Verilog 2001：
2024-08-26 20:42:49
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原创 Gowin软件中 RAM16S/RAM16SDP IP核为浅灰色
高云FPGA开发软件Gowin中IP Core Generator界面中的Memory-Shadow memory-RAM16S/RAM16SDP ip核为灰色：
2024-04-15 15:27:47
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原创 ERROR (EX3934) : Loop count limit of 2000 exceeded, condition is never false
在使用高云FPGA开发软件时，遇上了如题所示的报错，ERROR (EX3934) : Loop count limit of 2000 exceeded, condition is never false("D:\GaoYun\Project\practice\ip_test\src\ip_test_tb.v":24)
2024-04-15 15:02:33
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原创 【友善串口调试助手Serial Port Utility以ASCII形式发送字节数据显示0D的问题】
使用串口助手Serial Port Utility发送ASCII字符显示错误数据0Dh的问题
2023-11-19 18:17:43
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