FPGA-工具篇
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SDK下载报错
将原来的SYSTEM删掉，重新生成一个即可。原创 2025-04-14 13:46:01 · 826 阅读 · 0 评论 -
vivado布线出错opt 31 - 67(opt 31 - 155)
我通过功能（有点玄学得味道了）联想到它能到得双向io得位置，然后在代码中发现我送回给双向io得大位宽数据信号有高位部分是没有赋值得（代码中仅对低位数据进行了赋值得，因而一般高位为不确定状态），出于规范性得出发点，我将高位全部置零，然后error就消失了，因此反推应该是高位数据这里将信号阻断了导致布线无法找到数据源。原创 2024-02-22 15:05:49 · 1414 阅读 · 0 评论 -
安路远程调试使用chipwatcher报错
让外地同事远程帮忙抓信号，只给了bit和cwc文件（我的理解是cwc对应vivado的ltx文件）把图中提示的_inst.bid文件放到下载bit的路径中。然后上次没出问题，这次报错，无法触发波形。原创 2023-11-22 09:37:30 · 714 阅读 · 4 评论 -
ddr3_reset_n一直复位导致仿真初始化失败
解决ddr3初始化失败（仿真）的一种办法原创 2022-08-02 10:46:30 · 3515 阅读 · 2 评论 -
# ** Error: ../tb/bfm/bfm_tb_ddr3/bfm_tb_ddr3.v(186): Illegal task output argument.
error : task otput argument原创 2022-07-27 14:02:49 · 422 阅读 · 0 评论 -
modelsim报错Error: (vsim-3033)
高云modelsim联合仿真报错3033原创 2022-04-14 09:24:21 · 2851 阅读 · 0 评论 -
# ** Fatal: (vsim-3729) Value ?(1095521093) of generic “EN_ECC_READ“ is out of range FALSE (0) to TR
解决办法：3729可能是语言冲突了所以一个要在另外一个的前面转载 2022-04-08 12:52:01 · 915 阅读 · 5 评论 -
[Synth 8-2543] port connections cannot be mixed ordered and named [“F:/FPGA_Prj/GPIC_2000/GPIC_AB/V1
一个解决办法原创 2022-02-24 13:06:59 · 1082 阅读 · 0 评论 -
vivado编译fifo出错modelsim
fifo在modelsim里面编译的办法，vivado原创 2022-02-23 10:40:40 · 1744 阅读 · 0 评论 -
vivado2017生成mcs文件办法
vivado2017生成mcs文件办法跑布线生成mcs文件，记得勾选bit文件下载mcs文件原创 2022-02-16 09:56:35 · 2854 阅读 · 0 评论 -
vivado理解/原语
名词解释原创 2021-04-17 15:53:44 · 4162 阅读 · 2 评论