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把握今天，才能拥有明天！ 参考资料：Verilog数字系统设计与FPGA应用 Verilog HDL 系统的设计 步骤： 1.把系统划分成模块 2.规划各模块的接口 3.对模块的编程并连接各模块的系统设计 Verilog HDL 程序的基本结构 module模块名（端口列表） 端口定义： input 输入端口 output 输出端口 inout 输入输出端口 数据类型说明： wire r...

把握今天，才能拥有明天！ 参考资料：Verilog数字系统设计与FPGA应用 词法规定： 关键字 标识符 格式 常量及其表示： Verilog HDL用4种基本的值来表示逻辑电路的逻辑状态 0 ：逻辑0或“假” 1：逻辑1或“真” x：未知状态 z：高阻 常量： 整数：<+/->< size>’< base format>&lt

把握今天，才能拥有明天！ 参考资料：Verilog数字系统设计与FPGA应用 按功能分类：算数运算符，逻辑运算符，关系运算法，等式运算符，缩减运算符，条件运算符，位运算符，移位运算符和拼接运算符9类。 算数运算符 +，-，*，/，% 位运算符 ，&，|，^,^ 缩位运算符 与位运算符的逻辑运算法则一样，但为单目运算符 关系运算符 > ...