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RSS订阅原创 锁相环PLL
锁相环PLL作用：将片外晶振产生的时钟进行分频或倍频，产生更高或更低频的时钟信号供逻辑使用；也可以对同一PLL产生的时钟的相位进行控制，以保证两个时钟域的工作有着相同的时间差。（比如SDRAM的读写，需要控制 SDRAM_controler和SDRAM的时钟信号相差180°）...
2020-06-21 23:09:00
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原创 Verilog HDL的编译预处理
Verilog HDL的预编译处理Verilog HDL的预编译处理新的改变功能快捷键合理的创建标题，有助于目录的生成如何改变文本的样式插入链接与图片如何插入一段漂亮的代码片生成一个适合你的列表创建一个表格设定内容居中、居左、居右SmartyPants创建一个自定义列表如何创建一个注脚注释也是必不可少的KaTeX数学公式新的甘特图功能，丰富你的文章UML 图表FLowchart流程图导出与导入导出导入Verilog HDL的预编译处理你好！ 这是你第一次使用 Markdown编辑器 所展示的欢迎页。如果
2020-06-16 15:51:26
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转载 Modelsim独立仿真vivado IP核
Modelsim独立仿真vivado IP核链接: https://wenku.baidu.com/view/9c6c7500640e52ea551810a6f524ccbff121ca1a.html(https://mp.youkuaiyun.com).链接: https://www.cnblogs.com/ninghechuan/p/8305925.html
2019-11-12 22:21:25
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原创 C语言-如何输入任意长度数据
作为初学者（转方向后的边用边学（你一定想不到我学的第一门语言是Verilog HDL））,用来识别一个特殊字符作为任意长度的结尾，那getchar()函数个人感觉算比较好用的一个了。其头文件#include<stdio.h>好，接下来说我自己的用法。百度到getchar()是获取一个字符，ok一个刚好！So，根据我自己的输入需求，检测到'\n'就从接受数据的循环中跳出。#i...
2018-11-20 18:53:14
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空空如也
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