Quartus18.1自带仿真工具实现仿真

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#Quartus18.1 #仿真 #自带仿真器 #FPGA #Verilog

本文介绍了在Win10环境下，使用Quartus Prime 18.1 Standard Edition进行FPGA设计仿真的步骤。首先，概述了软件版本需求。接着详细阐述了设计流程，包括源程序代码的编写，以及如何新建并配置仿真波形文件。在新建仿真波形文件部分，提到了通过Node Finder选择仿真所需的端口，并添加激励，特别强调了时钟设置的注意事项。最后，演示了如何开始仿真并展示了简单的仿真结果。

Quartus18.1自带仿真工具实现仿真

1. 软件版本

win10 下使用“Quartus (Quartus Prime 18.1) Standard Edition”版本测试，其他版本均可。

2. 设计流程

2.1 源程序代码

此处忽略…
放上部分截图，建议先用简单项目进行测试
在这里插入图片描述

2.2 新建仿真波形文件

  • File—New—University Program VWF，出现下面界面
    在这里插入图片描述
  • 双击左边空白处，弹出新界面
    在这里插入图片描述
  • 点击Node Finder
    在这里插入图片描述
  • 点击List
    在这里插入图片描述
  • 选择仿真需要
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二是，虽然仿真环境软件是自带的，但还是需要安装License文件，由于安装的是Quartus Prime Lite版本，License文件是免费提供的，但是需要在线安装，如下图：在Tools->License Setup选项，选择Get no-cost License，然后软件会自动联网安装。编译完成之后，想进行仿真试一下，就加载了仿真用的文件tb_led.v，准备用quartus prime自带的仿真软件进行仿真验证，激励源设计是产生随机数作为输入信号，输出信号应同步跟随输入信号进行变化。
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quartus18.1 怎么用LPM实现浮点数加减法
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提供的引用内容中未提及Quartus 18.1使用LPM实现浮点数加减法的方法。不过，通常来说，使用Quartus 18.1通过LPM（Library of Parameterized Modules）实现浮点数加减法可按以下通用步骤进行： 1. **打开Quartus 18.1并创建新项目**：启动Quartus 18.1软件，按照向导创建一个新的项目，指定项目名称、保存路径等信息，并选择合适的FPGA芯片型号。 2. **调用LPM模块**：在项目中通过“Tools” -> “MegaWizard Plug-In Manager”打开MegaWizard工具。在该工具中选择与浮点数加减法相关的LPM模块，可能是`lpm_add_sub`（用于加减法）等。根据向导提示设置模块的参数，如数据位宽、是否有符号等，以适应浮点数运算的需求。 3. **编写顶层设计文件**：创建一个顶层的Verilog或VHDL文件，将调用的LPM模块实例化到该文件中，并连接好输入输出端口。以下是一个简单的Verilog示例代码： ```verilog module floating_point_add_sub ( input wire clk, input wire [31:0] a, input wire [31:0] b, input wire add_sub_select, output wire [31:0] result ); // 实例化LPM模块 lpm_add_sub #( .LPM_WIDTH(32), .LPM_REPRESENTATION("SIGNED"), .LPM_DIRECTION("UNUSED") ) uut ( .dataa(a), .datab(b), .cin(1'b0), .sub(add_sub_select), .result(result), .cout(), .overflow(), .aclr(1'b0), .clock(clk) ); endmodule ``` 4. **编译项目**：对编写好的设计文件进行编译，检查代码中的语法错误和逻辑错误。若有错误，根据Quartus 18.1的报错信息进行修改。 5. **仿真验证**：可以使用Quartus 18.1自带的仿真工具或第三方仿真工具（如ModelSim）对设计进行仿真。创建仿真波形文件，为输入信号添加激励，观察输出结果是否符合预期。 6. **下载到FPGA**：编译和仿真都通过后，将生成的配置文件下载到目标FPGA芯片中，进行实际的硬件测试。
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