DSP28335 时钟、外设及寄存器配置

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本文深入解析F28335的时钟产生过程，从外部时钟到内部各模块的时钟分配，包括PLL倍频、SYSCLKOUT产生及高速、低速时钟配置。详细阐述了不同时钟组的功能与应用。

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1.时钟产生过程

外部时钟或者外部晶振给F28335提供时钟源OSCCLK，使能F28335片上PLL电路，PLL电路对时钟源信号进行倍频，产生时钟CLKIN，CLKIN通过CPU产生时钟SYSCLKOUT，SYSCLKOUT经过分频可以产生低速时钟LOSPCLK和高速时钟HISPCLK，最后OSCCLK、CLKIN、SYSCLKOUT、LOSPCLK和HISPCLK给各个模块提供时钟。

2. 片上外设按输入时钟分组

（1）OSCCLK组：看门狗电路
（2）CLKIN组：CPU
（3）SYSOUTCLK组：PWM、eCAP、eQEP、CPU Timer
（4）低速组(LOSPCLK)：I2C、SCI，SPI，McBSP
（5）高速组(HISPCLK)：ADC
（6）直接2分频给eCAN

3.配置SYSCLK

分频寄存器的 位分配参考《手把手教你学DSP28335》54-56页
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4.配置高速、低速时钟
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DSP28335时钟配置
weixin_44913038的博客
05-16 7754
一、控制外设时钟的寄存器有以下几个： PCLKCR0（外设时钟寄存器0）:作用于上图标黄外设，所有时钟默认不开启 注：这里需要注意TBCLKSYNC这个寄存器，他是让ePWM模块时钟同步，且当检测到TBCLK的上升沿时，同步开启。另一个需要注意的是，及时这个寄存器没有使能ePWM,如果PCLKCR1使能了一样有效。 对于使能ePWM推荐做法： • Enable ePWM module clocks in the PCLKCR1 register. • Set TBCLKSYNC to 0. • Confi.
DSP28335系统时钟
Tristan的博客
11-30 6095
一、振荡器OSC和锁相环PLL模块 锁相环是一种控制晶振使其下你跟对于参考信号保持恒定的电路。主要作用是通过软件实时配置片上外设时钟 譬如当30MHz的OSCCLK信号经锁相环倍频后，倍频倍数可通过PLLCR[DIV]设置，可设置为10，经过PLL后的信号变为300MHz，因为28335的时钟频率为150MHz，所以需要将PLLSTS[DIVSEL]设置为2，可得300/2=150MHz时钟信号。 二、各种时钟信号 1.外设时钟 下图是系统控制及外设时钟，CLKIN是经过PLL模块后送往CPU的时钟信号
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PLL作用就是对外部时钟进行倍频，降低产生高频时钟信号的成本。但是倍频配置的时候，需要在特定的条件下更改，因此需要检测PLL工作的各种状态信号，因此PLL有两个配置相关寄存器，PLL状态寄存器PLLSTS和PLL控制寄存器PLLCR。通过对状态寄存器PLLSTS的判断，可以判断PLL的工作状态，在特定的工作状态下，对PLL控制寄存器PLLCR进行配置，最后产生合适的时钟信号CLKIN输入给CPU，完成整个过程的倍频。
004-TMS320F28335 DSP外设详解：GPIO的配置与应用
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GPIO是通用输入输出接口的简称，它提供了最基本也是最灵活的输入输出功能。28335拥有丰富的GPIO资源，可满足多种应用场景的需求。GPxMUX寄存器（功能选择寄存器）作用：用于选择GPIO引脚的工作模式，即通用数字I/O模式或其他外设功能模式。配置方法：将GPxMUX寄存器的相应位设置为0，表示将引脚配置为通用数字I/O模式；设置为1，则表示配置为特殊外设功能模式。GPxDIR寄存器（方向控制寄存器）作用：用于设置GPIO引脚的方向，即输入或输出模式。配置方法：将GPxDIR。
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因此，PLL 广泛用于无线电、电信、计算机（例如在微处理器中分配精确定时的时钟信号）、并网逆变器（用于将直流可再生资源和存储元件（如光伏和电池）与电网集成的电子电源转换器）和其他电子应用。相关器件：锁频环 （FLL） 是一种电子控制系统，可生成锁定到输入或 “参考” 信号频率的信号。[1]该电路将受控振荡器的频率与参考频率进行比较，自动升高或降低振荡器的频率，直到其频率（但不一定是相位）与参考频率匹配。在一些应用中，可以将看门狗设置为触发中断，而不是复位系统。：SPI 模块时钟的分频因子由。
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看了一下官方的技术手册，里面很多描述的是一些关于不同模式下时钟寄存器的设置流程与会有什么现象，在此就不一一赘述了，导入了一下官方例程，官方对于时钟的设置已经编写好函数了，我们直接使用即可。使用相应外设时，通过PCLKCR0、PCLKCR1、PCLKCR3寄存器使能相应外设时钟即可，官方例程几乎默认全开，我这边不做更改，和官方例程相同。从下面的框图我们可以看到，时钟源到CPU的时钟频率除了时钟源本身频率外，主要是由PLLSTS[ ]寄存器和PLLCR[ ]寄存器决定的。
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