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努力成为ICer,重芯开始
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Xilinx RTL编码指南(一)
Xilinx RTL编码指南(一控制信号与控制集Reset使用复位的时间和位置同步复位与异步复位复位编码实例 1:乘法器与异步复位异步复位RTLsynthesis同步复位RTLsynthesis尝试消除HDL代码复位时出现问题时钟使能创建时钟使能复位和时钟使能的先后使用综合属性控制使能/重置提取DIRECT_ENABLEDIRECT_RESET将逻辑从控制引脚推到数据引脚信号控制技巧 该一系列为学习ug949-vivado-design-methodology.pdf的记录,该文档包含了对Xilinx器件最原创 2021-04-03 23:45:26 · 2838 阅读 · 1 评论 -
7系列FPGA逻辑资源解析
前言 之前使用过7系列相关的FPGA,但一直没有了解过7系列FPGA的逻辑结构,所以感觉有些遗憾,7系列FPGA的逻辑结构参考资料: wp 405-7 series FPGAS The Logical Advantage ug 474-7 Series FPGAs Configurable Logic Block 本文翻译自wp 405-7series FPGAS The Logical Advantage,就是7系列逻辑优势的白皮书,自然先看白皮书了,不过翻译过程中,难免有疏漏,希望读者指正批评原创 2021-03-31 14:25:51 · 3624 阅读 · 0 评论