timescale problem in systemverilog

最新推荐文章于 2025-06-04 15:01:54 发布
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#delay

本文强调了在编写代码时明确指定timescale的重要性。如果未指定timescale或使用的延迟时间单位小于默认精度，则该延迟会被忽略。文章建议开发者：1）始终定义timescale；2）使用不带单位的延迟。
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如果没有指定timescale，或者 timeunit 那么整个环境会用default的值，（VCS 好像是秒 s）， 如果你在code中使用了

......
#1ns;
......

对不起，这一纳秒的delay被完全忽略了。 因为1ns小于timescale的精度, 所以被忽略为零。

因此个人以为应该

1） 指定timescale

2） 尽量用不带单位的delay


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