linux下的EDA——VCS与Verdi仿真

本文介绍了如何在Linux系统中利用VCS进行仿真,并结合Verdi进行波形观察。通过指定PLI使用Verdi的PLI,生成.fsdb和.vcd波形文件,然后在Verdi中打开波形界面进行信号分析。同时,文章提到了VCD、fsdb、shm和vpd等不同类型的波形文件及其特点。

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保证VCS与Verdi已经正确安装之后开始仿真,使用代码与之前一致。


对testbench进行增改,在其中加入如下语句:

initial begin
    $fsdbDumpfile("counter.fsdb");
    $fsdbDumpvars(0,u0);
end
含义为产生Verdi所需的fsdb文件,对tb中的所有层的信号均抓取。保存testbench。

### 关于VCSVerdi联合仿真的操作指南 #### 工具简介 VCS 是一种高性能的功能验证工具,主要用于RTL级硬件描述语言(如Verilog、SystemVerilog)的设计仿真[^1]。它能够快速编译并运行大规模电路模型,提供详细的波形数据和其他调试信息。而 Verdi 则是一种强大的波形查看器和调试平台,支持复杂的信号追踪和分析功能。 两者的结合可以显著提升设计人员的工作效率:VCS 负责执行仿真并将结果保存到特定格式的日志文件中,随后通过 Verdi 加载这些日志文件来观察波形以及进行深入的错误定位。 --- #### 基本流程概述 以下是基于 Linux 平台的一个典型工作流: 1. **准备源码** 将待测试的 RTL 文件准备好,并编写相应的测试激励脚本 `testbench`。 2. **编译阶段** 使用 VCS 编译命令将所有的模块连同测试激励一起转化为可执行程序。例如: ```bash vcs -sverilog top_module testbench -o simv ``` 这里 `-sverilog` 表明我们使用 SystemVerilog 的语法特性,`top_module` 和 `testbench` 分别代表顶层模块名及其对应的测试激励名称,最后指定输出二进制文件名为 `simv`[^1]。 3. **运行仿真** 执行生成好的模拟器: ```bash ./simv +vpdfile=wave.vpd ``` 参数 `+vpdfile=wave.vpd` 指定了用于存储波形记录的目标文件路径。 4. **加载至 Verdi 查看波形** 启动 Verdi 应用程序后打开之前产生的 `.vpd` 波形文件即可直观地浏览各个节点的变化情况: ```bash verdi -ssf wave.vpd ``` 上述过程构成了一个完整的从代码输入到最后可视化输出的过程框架[^1]。 --- #### 提高效率的小技巧 - 自定义 Makefile 来简化重复性的构建任务; - 设置合适的断点或者条件触发机制以便更精准地捕捉异常行为; - 学会利用 Verdi 中的各种插件扩展其基础能力范围,比如覆盖率统计等功能组件。 ```makefile # 示例Makefile片段 all: compile run compile: vcs -sverilog $(TOP_MODULE) $(TESTBENCH) -R -l comp.log run: ./simv +vpdfile=$(WAVEFORM_FILE).vpd | tee run.log ``` 以上展示了如何借助 GNU make 实现自动化管理整个项目周期内的各项活动步骤。 --- 问题
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