南京芯麒电子FMC子卡-基于AD9208的4路14bit 3GSPS AD采集子卡

最新推荐文章于 2025-05-06 21:36:40 发布
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        FMC513是一款基于FMC+标准的高采样率、高分辨率子卡产品，可实现4路14bit、3GSPS/2.6GSPS/2GSPS AD采集功能。板卡ADC器件采用ADI公司AD9208芯片（兼容AD9689），通过一个高密度连接器（FMC+）可搭配各类FPGA底板一起使用，应用于雷达信号处理、软件无线电、电子战、大规模MIMO等。

  • 标准FMC+子卡（ANSI/VITA 57.4）；
  • ADC芯片采用两片ADI公司AD9208芯片，可实现4路14bit 3GSPS/2.6GSPS/2GSPS AD采集；
  • 时钟选择灵活：内部时钟、外部时钟选择可由载板控制
  • 板卡芯片全部采用工业级芯片。

主芯片

2片AD9208

原理框图

FMC137.jpg

 

主要技术指标

ADC性能指标（AD9208）：

JESD204B(子类1)编码数字输出，最高支持16Gbps/lane；

1.65W总功耗（3GSPS采样率）；

SNR；

最低0.47元/天 解锁文章
AD9208调试记录（简略版）
weixin_43813325的博客
04-07 5907
设计选用推荐型号AD9208实现，AD9208 是一款低功耗、高带宽 16 位、1.0GSPS 双通道模数转换器 (ADC)。该器件经设计具有高信噪比 (SNR)，可提供 -159dBFS/Hz 的噪底，从而协助应用在宽瞬时带宽内实现最高动态范围。支持 JESD204B 串行接口，数据传输速率高达 10Gbps，每个 ADC 可支持 2 或 4 条通道。已缓冲模拟输入在大大减少采样保持毛刺脉冲能量的同时，在宽频率范围内提供统一的输入阻抗。可选择将每个 ADC 通道连接至数字下变频器 (DDC) 模块。AD9
2 路 2GSPS/2.6GSPS/3GSPS 14bit AD 采集卡/ FMC 子卡 （AD9208/ AD9689）
F_white的博客
09-07 2841
FMC152 是一款基于 VITA57.1 标准的，实现 2 路 14-bit、2GSPS/2.6GSPS/3GSPS AD 采集 FMC 子卡模块。该模块可直接与FPGA 载卡配合使用，板卡 ADC 器件采用 ADI 的AD9208 芯片，与 ADI 的 AD9689 可以实现 PIN 脚兼容。该模块全功率模拟输入带宽（-3dB）可达 9GHz，可支持本地时钟、外参考时钟、外采样时钟三种模式，可通过 SPI 总线实现时钟配置。模块支持外同步，可实现多个板卡的同步互联。
AD9208的4通道 14-bit、2.4GSPS采样率之中文版资料
beijingqingyikeji的博客
04-25 1316
4通道 高速采集 14-bit 2.4GSPS采样率
[FMC152]AD9208的2 路2GSPS/2.6GSPS/3GSPS 14bit AD 采集FMC 子卡模块中文版本设计资料及调试经验
beijingqingyikeji的博客
05-17 585
AD9208的2 路2GSPS/2.6GSPS/3GSPS 14bit AD 采集FMC 子卡模块中文版本设计资料及调试经验
基于AD9208的2路3G AD和AD9172的2路12G DA FMC子卡
zhengzhiyi312的博客
02-18 293
基于AD9208的2路3G AD和AD9172的2路12G DA FMC子卡
AD9208/AD9689/AD6688采集和AD9172/AD9174/AD9176回放FMC
universaldata的博客
07-27 1805
ADC支持：AD9689-2000、AD9689-2600、AD6688、AD9208 DAC支持：AD9171、AD9172、 AD9173、AD9174、AD9175、AD9176
AD9208之8通道高速采集
beijingqingyikeji的博客
04-24 1717
8通道高速采集 强同步性
AD9208调试经验分享
beijingqingyikeji的博客
04-21 1529
标准的 4 路 2GSPS/2.6GSPS/3GSPS14 位 AD 采集子卡模块
AD9208子卡设计资料： 2 路 2.6GSPS/3GSPS AD 采集、2 路 12.6G DA 回放、高性能时钟发生器HMC7044 -FMC 子卡模块
beijingqingyikeji的博客
04-27 1036
2 路 2.6GSPS/3GSPS AD 采集、2 路 12.6G DA 回放、高性能时钟发生器HMC7044 -FMC 子卡模块 AD9208 2.4GSPS采样率
南京芯麒电子FMC子卡-基于AD9689的2路14bit 3GSPS AD 采集 AD9176的2路16bit 12.6GSPS DA回放子卡
m0_63776781的博客
01-16 339
FMC521是一款基于FMC标准的高采样率、高分辨率子卡产品，可实现2路14-bit、3GSPS ADC采集、2路16-bit 12.6GSPS回放功能。板卡ADC器件采用ADI公司AD9689芯片，与ADI公司的AD9208可以实现PIN脚兼容，DAC器件采用ADI公司的 AD9176，通过一个高密度连接器（HPC）搭配各类FPGA底板一起使用，应用于软件无线电、电子战、大规模MIMO等。工作温度：-40°~﹢85°C；板卡尺寸：78 x 69mm；支持Xilinx开发板移植；散热方式：风冷或导冷散热；
FMC子卡：AD9680子卡 / 基于 VITA57.1 标准的 4 路 500MSPS/1GSPS 14 位 AD 采集子卡
F_white的博客
09-28 1868
FMC139 是一款基于 VITA57.1 标准规范的 JESD204B 接口FMC 子卡模块，该模块可以实现 4 路 14-bit500MSPS/1GSPSADC 采集功能。板卡ADC ： AD9680 。全功率-3dB 模拟输入带宽可达 2GHz。该 ADC 与 FPGA 的主机接口通过 8通道的高速串行 GTX 收发器进行互联。 该板卡可用于通信与无线基础设施、雷达、宽频带通信、毫米 波通信、自动测试设备等。 实物图 逻辑框图 性能参数 ADC 性能指标（AD9680）：  JESD2
FMCJ469-基于AD9988的四路4 GSPS@ 12 bit,四路12 GSPS@16 位4T4R 射频FMC子卡
2301_79912794的博客
10-31 944
AD9988 是一款高度集成的套件，具有四个 16 位、12 GSPS 最大采样率、RF 数模转换器 (DAC) 内核，以及四个 12 位、4 GSPS 速率、RF 模数转换器 (ADC) 内核。用户指南介绍了 AD9081-FMCA-EBZ、AD9082-FMCA-EBZ、AD9986-FMCB-EBZ 和 AD9988-FMCB-EBZ 评估板，它们提供操作各种模式和配置下的 AD9081、AD9082、AD9986、AD9988 、AD9207、AD9209 或 AD9177 所需的所有支持电路。
FMC ADDA子卡 2 通道 14bit 2 通道 3GS/s ADC +16bit 2 通道 12.6GS/s DAC AD9208/AD9172/AD9689
FPGA_ADDA的博客
10-31 1068
14bit 2 通道 3/2.6/2GS/s ADC +16bit 2 通道 12.6GS/s DAC FMC AD/DA 子卡 是一款高分辨率、高采样率的 ADC+DAC FMC 子板。它同时支持 2 路 14 位 3.0/2.6/2.0GS/s 的 A/D 通道输入和 2 路 16 位 12.6GS/s 的 D/A 通道输出， 全功率模拟 -3dB 输入带宽可达 9GHz。
提高设计的综合性能
m0_46644085的博客
04-30 439
导致设计出现问题的隐患有很多，其中主要是 非法输入 和 环境干扰。记得要约束 keep_hierarchy 防止被优化。一般来说 ， RAM 比 FIFO 具有更好的鲁棒性。状态机的鲁棒性就代表FPGA的鲁棒性。对部分FPGA电路重构。指对FPGA从新配置。
7系列 之 IO_FIFO
扶桑树下、拂晓之时
05-06 736
IO_FIFO在物理布局上与I/O字节组对齐，当用于连接I/O SERDES等IOI组件时，这种对齐方式能实现最优性能，而这是其最常用的场景。此外，无论位置如何，IO_FIFO 都可以与 FPGA 内部结构和其他 I/O bank 中的资源交互。对于输入FPGA的外部数据，IN_FIFO可连接至ILOGIC（如ISERDESE2、IDDR或IBUF）接收数据并传递至架构内部；对于输出数据，OUT_FIFO可连接至OLOGIC（如OSERDESE2、ODDR或OBUF），将数据从内部结构传递到 IOB。
FPGA----基于ZYNQ 7020实现petalinux文件持久化存储
最新发布
qq_37912811的博客
05-06 465
为了解决petalinux文件固化这个问题，您需要将根文件系统（rootfs）配置为使用 SD 卡上的持久性存储（如 ext4 分区）。
原语的使用
m0_46644085的博客
04-29 467
原语（ primitive ），是FPGA开发环境所提供的一系列逻辑功能单元。往往与FPGA芯片的厂家精密相连，不同厂家的原语往往不能通用。
使用DDR4控制器实现多通道数据读写(十)
weixin_38828382的博客
04-29 1103
所以只要根据fifo_1的几乎满（wrfifo_almost_full）信号为低电平状态就可以控制数据写入，根据fifo_2d的空（rdfifo_empty）信号为低电平状态就可以控制数据输出。如果写入的数据和读取的数据不相同，error_1就会拉高，可以通过error_1的状态判断ddr循环读写的功能是否正确。上图中，可以看到，读出的数据数量和存入的数据数量相等，并且可以观察到，测试工程中可以存储的数据数量为ddr4的最大存储量加上两个fifo的存储量。2、读出数据测试代码。本文章由威三学社出品。
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