m0_56903617的博客

数字对：由两个1到9之间的整数组成的有序集合，记为(m,n)。若m≠n，则(m,n)与(n,m)视为不同的数字对。游戏双方：B方和W方，各自拥有一个集合（B集合和W集合），初始为空。K集合：未出现在B集合和W集合中的所有数字对。邻居关系：两个数字对(m,n)和(a,b)，若n=b且|m-a|=1，或m=a且|n-b|=1，则称它们为邻居关系。粘连关系：若A与B有邻居关系，B与C也有邻居关系，则A与C有粘连关系。粘连块：根据粘连关系将B集合和W集合分割成的若干子集合。气集合。

数字对：由两个1到9之间的整数组成的有序集合，记为(m,n)。若m≠n，(m,n)与(n,m)视为不同的数字对。游戏双方：B方和W方，各自拥有一个数字对集合，分别为B集合和W集合。游戏开始时，这两个集合均为空。K集合：包含所有未出现在B集合和W集合中的数字对。邻居关系：两个数字对(m,n)和(a,b)是邻居，如果m与a或n与b的差为1。粘连关系：若A与B是邻居，B与C也是邻居，则A与C也有粘连关系。粘连块：根据粘连关系将B集合和W集合分割成的若干子集合。气对。

DeepSeek能下围棋吗？今天天气不好，我们换个地方，乘高铁旅行。这次来挑战一下围棋规则，但是全程不能提围棋两字，看DeepSeek能否理解我围棋规则，首先能否当个裁判，然后看看能否让它跟我下棋。为了简单起见，我们针对9路围棋，不过考虑到韩国规则那种提子必须放在棋盒盖的规则比较麻烦，用中国规则可能简单一些。下面描述围棋规则，第一次还没经过验证，后面可能有迭代过程。游戏规则定义：1.数字对，是指两个1到9之间的整数组成的有序集合。

文中给出一种命题逻辑的新的表达方式，用来测试AI大模型能否进行逻辑推理

模拟双眼的视角生成同一个场景的两个图片，用3D眼镜或者裸眼3D观察法让两个图片同时送到左右两只眼睛中，大脑（或人的视觉系统）自动脑补出3D场景，这种场景的立体效果比单一的图片效果好很多。这里采用OpenGL实现对双眼视角的模拟，使用gluPerspective生成透视模型，使用gluLookAt来实现对双眼的模拟。

17 AXI总线在实际的应用项目中，Xilinx的FPGA使用量比较大，所以买了一块Xilinx的FPGA开发板来做适配。现在的FPGA开发越来越集成化了，Altera有QSys，Xilinx则以AXI总线为基础来支持系统设计，它们的Vivado设计软件有图形化设计工具，提供了很多常用的IP核，减少了很多设计工作量，并通过代码自动生成减少了不少人为的错误。应该说，设计软件是否好用，直接降低了使用的门槛，让设计人员更加关注项目相关的逻辑设计，而不是关注一些符合性的八股文。本节介绍Vivado下的RISCV核

16 实用化的RISC-V CPU前面我们在FPGA开发板上实现了一个RISC-V的CPU，可以跑工具链编译出来的应用。然而感觉没有实用性，本次我们对CPU的设计做一些总结性的讨论，然后对这个RISC-V的CPU核进行改造，减少它的指令执行周期，增加一个外部设备，提供一个交互式的软件，让它可以用在一些FPGA的应用项目中。16.1 CPU设计的一些问题CPU，或者外推一下，包括DSP，GPU以及一些专用芯片中的处理器，其实称之为可编程通用状态机，可能更加贴切一些，后面还是用CPU来指称了。CPU设计其

15 RISC-V CPU的FPGA实现【请参考】01.HDL4SE：软件工程师学习Verilog语言（十四）02.HDL4SE：软件工程师学习Verilog语言（十三）03.HDL4SE：软件工程师学习Verilog语言（十二）04.HDL4SE：软件工程师学习Verilog语言（十一）05.HDL4SE：软件工程师学习Verilog语言（十）06.HDL4SE：软件工程师学习Verilog语言（九）07.HDL4SE：软件工程师学习Verilog语言（八）08.HDL4SE：软件工程师

14 RISC-V CPU初探前面我们介绍了verilog语言的基本语法特征，并讨论了数字电路设计中常用的状态机和流水线结构，然后我们借鉴SystemC的做法，引入了HDL4SE建模语言，以及相应的仿真系统，当然同时提供了verilog到这种语言的编译系统（部分功能尚未完成）。这个系列的最后一个目标是实现一个RISC-V的CPU核。本节先对RISC-V CPU进行初步的讨论，后面实现了一个用HDL4SE语言写的周期级别的可以运行的模型，可以看作是一个RISC-V CPU的行为级的CModel，它虽然简单，

13 HDL4SE环境和HDL4SE子集前面我们已经介绍了verilog语言的基本概念，虽然做了剪裁，但是我们所需要的RTL描述，基本上还是完整的。然而对于软件工程师而言，前面的描述有两个问题，一个是没有明确定义一个规范，另一个是范围还是过大。没有明确一个规范，也就是没有规定一个HDL4SE的verilog子集，很多内容存在发挥空间，每个人理解可能还是不大一致，加上IEEE. 1364-2005规范本身存在一些不够明确的地方，比如基本的表达式运算优先级只在文本中规定了，但是在后面的形式语法描述中居然没有给

#11 HDL4SE环境和HDL4SE子集前面我们已经介绍了verilog语言的基本概念，虽然做了剪裁，但是我们所需要的RTL描述，基本上还是完整的。然而对于软件工程师而言，前面的描述有两个问题，一个是没有明确定义一个规范，另一个是范围还是过大。没有明确一个规范，也就是没有规定一个HDL4SE的verilog子集，很多内容存在发挥空间，每个人理解可能还是不大一致，加上IEEE. 1364-2005规范本身存在一些不够明确的地方，比如基本的表达式运算优先级只在文本中规定了，但是在后面的形式语法描述中居然没有

11 流水线前面一节介绍了状态机的概念。状态机用于描述事物处理的一个程序性流程，可以组成顺序，分支，循环的事物处理流程。这些概念本来在verilog中的行为级描述中是有的，但是由于不是RTL描述，因此无法直接编译到电路，状态机提供了顺序分支循环等控制结构的RTL描述。然而状态机的缺点是，整个处理流程任何时候只会在一个状态中，只处理一个事务，比如描述一个软件工程师的工作，可能是需求分析，概要设计，详细设计，调试，测试，然后在这几个状态之间来回切换，用状态机是比较恰当的。但是如果对一个分工比较明确的团队，上

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1 引言2 基本程序结构3 线缆和寄存器4 常数、表达式与赋值5 if语句和case语句6 always块与initial块7 task与function8 元单元9 编译指示10 模拟运行与调试

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1 引言2 基本程序结构3 线缆和寄存器4 常数、表达式与赋值5 if语句和case语句6 always块与initial块7 task与function8 元单元9 编译指示10 模拟运行与调试

2 模块–程序结构

#1 引言

【摘要】本文试图在LCOM编程模型中引入面向接口的变量，为程序员提供更加灵活的编程模型。1 问题来由前面的文章LCOM:轻量级组件对象模型引入了一种类似于COM的一种编程模式，可以理解为COM的简化版本。其中以接口作为编程关注的核心，所有的功能都用接口定义，一个软件模块实现一个或多个对象，每个对象实现一个或多个接口，对外提供服务。每个接口定义为一组函数的集合，在COM中，这点规定得比较死，接口中是不允许出现变量的，以致于要访问一个对象的内部变量，甚至出现了var_Get, var_Set这样的接口函数。

【摘要】组件对象模型(Component Object Model,COM) 是微软公司首推的变成模型。它将软件分为接口和实现两个部分，由接口定义抽象的功能，一个实现模块则可能实现多个接口，来提供实际的功能。这样在一个大型软件中，可以将模块之间的耦合大幅度降低，降低模块管理的难度。有的嵌入式操作系统中也引入了COM模型，比如vxWorks。但是，COM模型为了兼顾分布式(DCOM)，实现二进制级的对象模型交换，显得比较复杂，基本代码量比较复杂，本文试图引入一种轻量级的组件对象模型，完全用c实现，核心部分非常

[摘要]本文我们先介绍OpenGL中的曲面细分的一些基本概念，然后给两个例子说明不得不用这项技术的理由。曲面细分是OpenGL 4.0之后才定义的功能，使用之前请确认你的显卡驱动支持OpenGL4.0以上。1. 曲面细分的目的OpenGL用透视变换将三维几何模型映射到二维平面上，这样随着透视参数（比如模拟相机位置，方向，角度，焦距等等）的不同，以及几何模型在场景中的位置和大小不同，几何模型在二维平面显示的大小会不同。在传统的OpenGL应用中，一个几何模型建立后，GPU是不能增减模型中的顶点的。这样一

切换到电脑上舒服多了手机上还是不够方便啊

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标题2备注：标题必须从行首开始，##之后要有空格1.说好的分级标题呢链过去OpenGL绘制分形图形MandelBrot集合外部链接的格式是[显示题目]（链接目标），括号必须半角才行。

接着测试##链过去OpenGL绘制分形图形MandelBrot集合

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