Jzzzzy1-优快云博客

原创 CIS半行采样，ISP1.25倍频半行数据交插合并，verilog实现

实现图像数据的交插跨时钟域合并

2025-07-22 14:38:01 921

原创 verilog写的I2C主机和从机驱动以及testbench

verilog写i2c的主从机驱动，可实现连续写和连续读

2024-08-01 19:29:06 1648 1

原创 FPGA 直方图均衡效果

matlab直方图均衡，可以看到建筑的一些细节了。matlab灰度处理下。

2024-04-24 17:36:49 221 3

原创用matlab和modelsim仿真图像处理的一些注意事项

随后就是用matlab读取和产生txt文件了，这里我也是用这位博主的matlab程序，但是仿真后却无法读出txt文档，查看波形发现过一段时间后，产生的data都是XXXXX，查看源头image也是这样，直接打开文档看看只有一百万个数据，远小于应该的1920*1080个。FPGA处理图像，可以先用modelsim仿真一下，就是原始图片转换成txt文档，把文档数据作为输入，通过自己写的处理模块后得到输出的txt文档数据，再使用matlab把文档转换成图片，查看写的模块是否正确。写一个顶层文件，例化模块。

2024-04-22 18:01:07 426 3

原创基于小梅哥的FPGA串口传图到TFT屏幕添加一个RGB转Ycbcr模块

基于小梅哥AC620的串口传图到SDRAM工程添加一个RGB转Ycbcr模块

2024-04-01 15:57:13 508

空空如也

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