FPGA入门——1位全加器 一、全加器与半加器 1.1 半加器 1.2全加器 二、原理图输入实现1位全加器 2.1 创建工程 2.2 原理图输入 2.3 将设计项目设置成可调用的元件 2.4 半加器仿真 2.5 设计全加器顶层文件 2.6 全加器仿真&同1.4 2.7 硬件测试 三、Verilog实现1位全加器 3.1新建工程 3.2.新建一个Verilog文件 3.3编译仿真 一、全加器与半加器 1.1 半加器 1.2全加器 二、原理图输入实现1位全加器 2.1 创建工程 选择目标芯片:CycloneIVE系列的EP4CE115F29C7 2.2 原理图输入 1.新建Block Diagram,输入and2 2.调入xnor、输入输出引脚input、output 3.连接好电路图,并修改输入输出引脚名字