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Tiramisu920
《平凡的世界》有这样的一句话：我们要一直向着远方，即使是青春之花凋谢，凋谢也是壮丽地凋谢。
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MYD-CZU3EG Board资源
从今天开始就开始使用MYD-CZU3EG Board开发板进行开发，目前的任务要实现PL去读写PS端的DDR4，PS端运行LINUX系统，读写PS-PL的共享FIFO数据通过网络TCP/UDP发送到PC端，同时PL端读PS端的DDR图像数据，进行HDMI显示。 1、MYD-CZU3EG Board开班资源 如果有大神路过，希望给点PL端读写PS端DDR4的资料，感激不尽~ ...原创 2019-11-27 10:04:29 · 560 阅读 · 0 评论 -
Arria 10上进行DDR3管脚分配
转发于改博客：https://blog.youkuaiyun.com/huan09900990/article/details/88920985 本文介绍下DDR3的管脚分配，FPGA型号:10AX027H4F34I3SG，DDR3型号：MT41J128M16JT-125，QuartusI Prime18.0 由于FPGA里对DDR的管脚分配有一定的限制，比如要求DQ,DQS,DM在一个组，地址，命令在某些b...翻译 2019-09-10 19:33:07 · 810 阅读 · 0 评论 -
pynq第一次使用
官网入门手册 https://pynq.readthedocs.io/en/latest/getting_started.html#configuring-pynq 首先设置从sd启动 供电设置 启动设置 其他就是链接网线了 网线可以直接和电脑链接，或是和路由器链接。 和电脑链接： 电脑访问输入 \\192.168.1.100\xilinx 浏览器访问输入 http://192.16...原创 2018-10-20 11:49:26 · 2802 阅读 · 0 评论 -
DE10_Standard开发板的学习过程（更改设备树）
1、下载镜像 镜像可以去友晶官网下载镜像下载地址，有两个镜像，一个是lxde一个是console控制台的，两个的Linux内核都是4.5的。这个去github上面下载，网址如下https://github.com/terasic/linux-socfpga选择Branch: socfpga-4.5 以后如果自己的需要添加自己的驱动，可以重新编译上面的内核就好，内核的编译可以按照rocketboar...原创 2018-09-30 09:19:34 · 5166 阅读 · 1 评论 -
ARRIA10学习之（4）
上一章的问题解决 自己编译C代码的经过 编译不能执行 上一章的问题解决 在ARRIA10学习之（3）linux启动失败的问题，现在已经解决了这个问题，过程大概这样。 因为我在ubuntu安装的quatusii ，我是直接用用命令运行 $ ~/intelFPGA//quartus/bin/quartus_cpf -c \ ~/cv_soc_devkit_ghrd/out...原创 2018-09-19 10:09:19 · 758 阅读 · 0 评论 -
ARRIA10学习之（3）
在ubuntu上安装putty之后，通过端口链接到开发板，这样可以不切换到windows下直接调试开发板。在次过程出现一些问题，这里记录一下。在上一遍中，由于出现那个unknown的问题，开发板上的linux无法成功的启动，还在找原因。 sudo apt-get install putty //安装putty dmesg | grep tty //显示检测到的系统串口支持,我的是显示tty...原创 2018-09-16 10:10:09 · 1164 阅读 · 0 评论 -
ARRIA10 学习之（2）
制作images的时候出现的错误 xml的学习 设备树语法 (Board Information Syntax)开发板语法信息` DTAppend 制作images的时候出现的错误 这个工程是基于DE10_standart开发板的DE10_Standard_GHRD工程添加的AXI总线。在用hps_common_board_info.xml和文件soc_syste...原创 2018-09-15 21:45:14 · 1304 阅读 · 0 评论 -
ARRIA10学习（1）
ARRIA10开发板原创 2018-09-09 09:46:34 · 2493 阅读 · 0 评论 -
arria10之FPGA学习链接
1、基于XRDP方式的远程桌面连接tab补全问 烂泥：学习ubuntu远程桌面（一）：配置远程桌面 2、avalon总线的学习 第四章avalon总线规范 3、Quartusii 调试工具之In-System Memory Content Editor https://blog.youkuaiyun.com/huan09900990/article/details/78890356 4、嵌入式l...原创 2018-09-03 09:21:40 · 1299 阅读 · 0 评论 -
FPGA调式出现的错误
1、时钟没有连上出现的错误 Error (15465): WYSIWYG primitive "ddr_avl_bridge:ddr_avl_bridge_i|wrfifo_for_sdram:wrfifo3_for_sdram_inst|wrfifo_for_sdram_fifo_161_jyih4oa:fifo_0|dcfifo_mixed_widths:dcfifo_mixed_width...原创 2018-08-31 10:06:17 · 1811 阅读 · 0 评论