FSMC，未用到的地址线会受影响吗？

STM32非复用模式配置要点
最新推荐文章于 2025-11-24 23:07:26 发布
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#mcu #经验分享 #单片机 #stm32

博客提及STM32相关配置，指出只要不将其配置为复用输出和复用输入模式即可，围绕单片机配置经验展开。

只要不配置为复用输出和复用输入模式即可

k_acm
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关于正点原子精英版库函数开发--TFT屏幕利用FSMC设置的地址线偏移量的解释
weixin_41011452的博客
07-13 846
如果你把地址只让A10是1，A0是0,那么就是0x400,如果把它作为第一个变量的地址，那么第二个变量的地址就是:0x400+2=0x402,会发现第11位也就是A10还是1,根本就没变，那就达不到作为数据/命令区分了，因为数据的时候要A10是0,命令的时候A10是1.所以必须为0x7FE。首先这个0x6C000000，为啥不是0x6C或者0x6C00或者0x6C0000，少个0少几个0不行吗？因为STM32单片机是32位的，所以地址都是32位的，我们知道0x前缀开始的都是十六进制的，那么。
FSMC-地址建立时间、地址保持时间、数据建立时间如何确定
u013073067的博客
02-27 6829
我们知道FSMC包括同步和异步两种工作时序。对于异步突发访问方式， FSMC 主要设置 3 个时间参数：地址建立时间(ADDSET)、数据建立时间(DATAST)和地址保持时间(ADDHLD)。这三个参数是怎么来的呢？是因为SRAM／ ROM、 PSRAM 和 NOR Flash 产品的信号时序有这三个参数，FSMC 综合了 SRAM／ ROM、 PSRAM 和 NOR Flash 产品的信号特点...
什么是FSMC
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文鸿开源工作室
11-30 1万+
转自正点原子论坛的一个回答：IO口和FSMC的详细区别 最早CPU要访问外部RAM需要三条总线：地址总线、数据总线（以16条地址线8位存储器为例）和控制总线 地址总线：A0到A15共计16根地址线 数据总线：D0到D7共计8根数据线 控制总线：至少包括读写控制等控制线 CPU要访问外部RAM，就得靠这些线来进行控制， 首先在这16根地址线上呈现地址值，指示要访问的目标地址，使得外部RAM可以定位...
STM32 ----小谈FSMC RS选择
gongyuan073的专栏
01-07 2224
原文:http://bbs.ednchina.com/BLOG_ARTICLE_2134144.HTM M32 FMSC  难点解析： 以下是网上和自己整理的：感觉应该可以把STM32 ----FSMC LCD中的关键RS说清楚~ -----------------------------------------------------------------------
FSMC寻址解析
bliu2_10的博客
11-21 1333
FSMC( Flexible static memory controller)全称“灵活的静态存储器控制器”，是 STM32中一个很有特色的外设，通过 FSMC，STM32可以通过FSMC与SRAM、ROM、PSRAM、Nor Flash和NandFlash存储器的引脚相连，从而进行数据的交换。利用FSMC写地址，不用手工设置地址线，MCU相应地址线自动设置高低电平选中存储外设的地址例如数据0xABCD被写入0x1234这个地址。
Keil5 优化级别引发的 FSMC花屏问题（附带FSMC配置）
嵌入式中手
04-06 3299
FSMC移植花屏问题
STM32 的FSMC功能理解
果果小师弟的博客
07-17 9475
FSMC全称“静态存储器控制器”。 使用FSMC控制器后，可以把FSMC提供的FSMC_A[25:0]作为地址线，而把FSMC提供的FSMC_D[15:0]作为数据总线。 (1)当存储数据设为8位时，(FSMC_NANDInitStructure.FSMC_MemoryDataWidth = FSMC_MemoryDataWidth_8b) 地址各位对应FSMC_A[25:0]，数据位对应FSMC_D[7:0] (2)当存储数据设为16位时，(FSMC_NANDInitStructure.FSMC_Memo
FSMC配置
Kudo_chitose的博客
08-08 1725
LCD显示中英文
STM32通过FSMC读写FPGA寄存器，高速通信
01-30
STM32F103V系列带FSMC的必须是VCT6及以上的型号。对应的IO口如下： 数据总线（16根） DB0 ： PD14 DB1 ： PD15 DB2 ： PD0 DB3 ： PD1 DB4 ： PE7 DB5 ： PE8 DB6 ： PE9 DB7 ： PE10 DB8 ： PE11 DB9 ： PE12 DB10...
【STM32】FSMC
Tesseract_9527的博客
08-27 2842
FSMC在正点原子的HAL课程中用法较为单一，就是用来模拟8080时序驱动LCD屏幕，其实就是利用FSMC读写LCD模块的SRAM。当然，这个我也没有买，只学习了理论。大部分图片来源：正点原子HAL库课程。
区块链与去中心化系统在高并发互联网架构优化与工程实践经验分享
2501_94114293的博客
11-24 798
架构分层与模块化主链+侧链、多节点分布式架构微服务化提高可扩展性和可维护性共识机制与交易处理优化批量打包交易、异步广播并行验证、交易分片、优先级处理智能合约与链上计算优化链下计算+链上验证合约逻辑优化、Gas管理和幂等性保证存储与缓存策略热数据缓存、冷数据分布式存储状态快照与增量同步提高性能工程化与监控闭环CI/CD自动化、容器化部署实时监控、告警、日志追踪形成持续优化闭环。
智能物流背景下基于 Python 构建高效仓储与配送调度系统的架构设计与工程实践经验分享
2501_94098874的博客
11-24 196
传统系统在处理高并发订单和复杂调度时，常常面临响应延迟和系统瓶颈。本文结合实际工程案例，从系统架构、数据采集、调度算法、并发处理、性能优化以及可视化与工程化实践等方面，系统分享 Python 在高并发智能物流场景下的落地经验和优化策略。总之，Python 在智能物流高并发调度系统中，以快速开发、丰富计算与优化库、异步协程和工程化部署能力为核心，能够支撑大规模订单、仓储作业和配送任务。结合日志和指标分析，定期优化热点函数、调度延迟和内存分配策略，形成完整的闭环优化机制，保障系统在高并发下的稳定运行。
面向企业级分布式系统的Java微服务架构设计与高性能实践深度探索与经验分享
2501_94094887的博客
11-24 477
Java微服务体系不仅是语言选择，更是一套完整的工程化实践与治理体系。通过合理的服务拆分、异步设计、性能优化和工程化建设，可以打造高可用、高并发、可持续演进的企业级分布式系统。微服务的成功关键不在于技术本身，而在于对业务边界的清晰理解、工程化能力的完善，以及持续性能优化的执行力。在Java生态的支持下，企业完全可以实现稳定、高效且可扩展的互联网服务架构。
网络安全与高并发防护架构在互联网系统中的设计优化与工程实践经验分享
2501_94114293的博客
11-24 320
分层安全架构CDN/WAF边缘防护 + API网关 + 数据加密零信任设计提高系统安全性高并发防护策略DDoS防护、限流、熔断、请求验证异常流量检测与自动阻断访问认证与敏感数据保护OAuth2.0/JWT、RBAC/ABAC权限管理数据传输加密与日志脱敏日志监控与持续优化闭环异常检测、告警、审计、优化形成闭环持续迭代提升系统安全与稳定性工程化与高可用设计CI/CD自动化部署多可用区部署、弹性伸缩和容灾机制保证业务连续性。
高并发数据库MySQL/PostgreSQL/NoSQL优化在互联网系统实践经验分享
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架构设计与分库分表主从/主主复制、分库分表、NoSQL分布式集群提高高并发读写能力和系统可用性索引与查询优化合理索引、SQL优化、聚合分页优化避免全表扫描和复杂JOIN高并发写入与缓存优化批量写入、异步处理、队列削峰热点数据缓存、读写分离策略监控与工程化闭环QPS、慢查询、锁等待、节点健康监控自动化部署、弹性扩容、压测优化形成持续闭环通过合理的数据库架构设计、索引与查询优化、高并发写入与缓存策略，以及监控与工程化部署，高并发互联网系统能够实现高吞吐、低延迟、稳定可靠、可扩展。
分布式数据库水平扩展与高可用架构在互联网大规模业务系统优化实践经验分享总结
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Sharding 设计合理，支持动态扩容主从复制 + 多活部署，保证高可用跨分片事务采用弱一致或补偿机制热点分片迁移与缓存优化监控、告警、自动扩容和运维闭环批量操作与流水线优化提高吞吐通过上述策略，互联网系统可实现：千万级用户访问支持毫秒级响应与高吞吐节点故障自动切换系统长期稳定运行弹性扩展支持业务增长分布式数据库系统才能真正支撑大规模互联网业务持续演进。
Node.js在高并发互联网系统中的异步架构设计与前后端协同优化实践经验分享
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11-24 478
异步优先所有IO密集任务必须异步化CPU密集任务通过Worker Threads或微服务拆分处理前后端协同API设计优化、批量请求、实时推送CDN和负载均衡提高响应速度缓存与数据库优化热点缓存、分库分表、读写分离异步访问避免阻塞Event Loop工程化与监控自动化CI/CD、容器化部署日志、指标、链路追踪形成闭环Node.js在高并发互联网系统中，凭借事件驱动、非阻塞I/O和异步架构，结合前后端协同优化、缓存与数据库优化及工程化监控，能够构建稳定、高效、可扩展的全栈微服务系统。
面向高性能计算与网络服务的C++微内核架构设计与多线程优化实践探索与经验分享
2501_94094887的博客
11-24 692
C++依然是高性能核心系统不可替代的语言，通过合理的微内核架构设计、异步事件驱动、多线程优化和工程化实践，可以打造高吞吐、低延迟、可扩展的互联网服务。系统性能的提升不仅依赖于语言特性，更依赖于对架构、并发模型、内存管理、网络IO和工程化规范的整体把控。通过持续优化与实践，C++可以支撑大规模、高并发的核心业务场景，实现稳定、可扩展的互联网服务体系。
STM32与FPGA间高速通信的FSMC接口实现
PD11到PD13被映射到地址总线的AB16到AB18，而其他未用到的地址线（AB19到AB23）可以用于扩展或者保留。 - 控制线用于控制读写操作，其中WR用于写操作，RD用于读操作，CS0用于片选，启用与FPGA的通信链路。 ##### 4...
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