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原创 Verilog Function函数语法说明
1.function的写法如下:function <返回值的类型或范围>(函数名)或<端口说明语句>; <端口说明语句> // input XXX(如果上面已定义可忽略) <变量类型说明语句> // reg YYY ......begin <语句> ...... 函数名 = ZZZ; // 函数名就相当于输出变量;endendfunction————————————————其中:
2021-12-01 16:09:38
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空空如也
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