Virtuoso IC618-二级运放电路设计

二级运放电路设计


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性能参数指标

VDD3.3V
VSS0V
偏置电流10uA
静态功耗≤1mW
开环增益≥70dB
相位裕度≥60°
单位增益带宽≥40MHz
共模抑制比≥60dB
输入失调电压≤0.5mV
转换速率≥30V/us

1.增益

Gm1为差分输入级PM0,PM1的跨导,g02,g04为PM2,NM4的阻抗

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2.NMOS/PMOS管I/V特性曲线


根据饱和电流公式,需要先通过MOS管的V/I特性曲线求出Kn.通过扫描Vgs得出电压-电流关系图,根据得到的数据列出对应的方程。

NMOS-V/I


依次扫描vgs(0.8-1.2),取vds=1v,1.5v下的数据
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PMOS-V/I

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同NMOS
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仿真的输入电V压3.3V,VGS设定为变值,根据扫描的两组I-V仿真数据得到得曲线可以计算出该工艺下的栅氧参数。

3.理论分析

3.1运放增益

首先,根据性能指标来分析,使运放增益达到70dB,本次采用二级结构的设计。第一级采用五管运放机构,第一级的增益可以轻松达到40db左右;第二级增益级采用共源放大级,让NMOS作放大级,PMOS作电流源负载。两级结构的结合是的增益可以轻松达到70dB。

3.2噪声分析

采用PMOS作为差分输入段,首先从噪声角度分析来看,PMOS管的噪声本来来说比NMOS噪声要低。负载端是一个NMOS电流镜结构,保持两路的电流相等,但也带来了较大的1/f噪声,所以尽可能使这两个NMOS管的L长一点。

3.3频率补偿

在第一级和第二级加入RC频率补偿电路,也有一点滤波效果。补偿电容的加入可以主极点往后拉远离次级点,这样可以使电路稳定性更好。电阻使用一个PMOS管来代替,使其工作在线性区可以充当电阻来使用。

3.4单位增益带宽积

补二级运放10ua设计,来不及更

### Cadence 中二级设计与仿真 #### 一、工具简介 Cadence Virtuoso 是一款广泛应用于集成电设计的EDA工具,在模拟电设计领域具有强大的功能。通过该平台可以实现从原理图绘制到版图生成的一系列操作。 #### 二、二级算放大器概述 二级算放大器是一种常见的高性能放大器件结构形式,其内部由两个级联的增益级组成,能够提供较高的开环电压增益以及良好的频率响应特性。为了确保稳定工作并优化性能表现,设计过程中需特别关注相位补偿机制的选择及其参数调整[^4]。 #### 三、基于gm/Id方法的设计流程 采用gm/Id(跨导除以电流密度)这一简化模型来进行初始尺寸估算能有效减少复杂度,并加快迭代速度。具体步骤如下所示: ```matlab % 假设已知目标参数:单位增益带宽UGBW=1GHz, 负载电容CL=10pF; % 计算所需最小偏置电流Ibias_min满足给定条件下的最大输出摆幅要求; % 利用公式 gm = UGBW * CL / (pi * fT),其中fT为特征频率;求解得到合适的MOS管宽度长度比(W/L)_n 和(MOS管宽度长度比)(W/L)_p ; ``` 此处需要注意的是,在实际项目开发中应当依据具体的半导体制造工艺文件所提供的阈值电压Vth等数据进一步校准上述理论计算结果。 #### 四、重要参数测量 完成初步布局布线之后,利用内置测试向量对成品进行全面评估至关重要。除了常规考察直流特性和交流小信号行为之外,还应着重检验以下几个方面: - **噪声水平**:衡量输入端引入随机扰动后引起输出波动的程度大小。 - **稳定性边界**(STB): 验证闭环配置下系统的动态平衡状态是否良好,防止发生振荡现象。 针对以上两点内容,可参照特定的应用实例编写相应的脚本程序辅助自动化处理过程[^2]。 #### 五、案例研究——带有相位补偿网络的两级OTA架构 当涉及到更复杂的多阶段互连情况时,则有必要引入额外元件构成反馈径的一部分来改善整体频响曲线形状。例如设置一个外部Miller电容器Cc连接于相邻节点之间即可起到延迟作用从而达到预期效果[^3]。
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