《Effective C++》读书笔记——写在开头

作者反思了工作九个月以来在C++技能上的停滞,决定通过阅读经典书籍如Effective C++等来提升自己的基础水平,利用公司资源进行持续学习。

写在开头


不知不觉工作已经9个多月快满一年了,感觉自己大部分时候也只是在搬砖,没有静下心来深入的学习C++的东西,很多以前在学校速成的时候不知道的现在还是不知道。前段时间经常看到高鹏、涛哥和Leon各种面试来应聘的人,经常听到给出“C++基础太差”的评价,就总是会心里不踏实,觉得自己现在再面试一次的话肯定会fail吧,真是不得不感谢徐斌去年给我offer啊。[手动捂脸]

前段时间在和Nitin谈话的时候我也提出了我的这一烦恼,他告诉我"The best way to not be upset is to keep learning"。确实,在学校的时候我也是从啥都不会过来的,进入了工作其实也是需要持续学习的。虽然自己之前也买了clean code,refactor code以及design patterns,不过这些书更多的focus在写好代码和软件开发的层次上,并不能解决基础知识不扎实的问题。今天鼓起勇气找leon询问了一下应该学习哪些东西,他给我列举了许多,包括

  • Effective C++
  • Effective STL
  • C++ API design
  • C++ object model
  • C++ concurrency in action

姑且就先从Effective C++开始吧,值得一提的是公司提供的O’Reilly Safari Book的会员还是非常给力的,经典的书籍一应俱全还不需要自己交钱订阅,可能比较难受的地方就是只有英文版吧,不过看原版也是更有好处的就是了。希望自己能好好坚持,从看完这本书开始,提升自己的综合水平。
目录

下载前必看:https://renmaiwang.cn/s/bvbfw Verilog设计_串并转换 / 移位寄存器实现了一种串并转换的功能,其核心原理在于移位寄存器的运用。 这里详细展示了串转并以及并转串两种不同的设计方案。 每一种转换模式都设有专属的使能信号,同时并行输出数据的格式提供了两种选择:最低有效位优先(lsb)和最高有效位优先(msb)。 串并转换技术主要应用于串行传输与并行传输这两种数据传输模式之间的相互转换,而移位寄存器是达成这一目标的常用工具,能够支持并行及串行的数据输入与输出操作。 这些移位寄存器通常被设定为“串行输入、并行输出”(SIPO)或“并行输入、串行输出”(PISO)两种工作模式。 在串行数据输出的过程中,构成数据和字符的码元会按照既定的时间顺序逐位进行传输。 相比之下,并行数据传输则是在同一时刻将固定数量(普遍为8位或16位等)的数据和字符码元同时发送至接收端。 数据输入通常采用串行格式进行。 一旦数据成功输入寄存器,它便可以在所有输出端同时被读取,或者选择逐位移出。 寄存器中的每个触发器均设计为边沿触发类型,并且所有触发器均以特定的时钟频率协同工作。 对于每一个输入位而言,它需要经过N个时钟周期才能最终在N个输出端呈现,从而完成并行输出。 值得注意的是,在串行加载数据期间,并行输出端的数据状态应保持稳定。 数据输入则采用并行格式。 在将数据入寄存器的操作过程中,/移位控制线必须暂时处于非工作状态;而一旦需要执行移位操作,控制线便会变为激活状态,并且寄存器会被锁定以保持当前状态。 只要时钟周期数不超过输入数据串的长度,数据输出端Q将按照预定的顺序逐位读出并行数据,并且必须明确区分最低有效位(LSB)和最高有效位(MSB)。
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