ddr3 仿真 &几个报错处理 - Warning - Carriage return (0x0D) is not followed by a newline (0x0A).

原创 已于 2025-09-10 08:37:27 修改 · 1k 阅读 · 6 ·
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#fpga开发

于 2023-08-30 09:14:58 首次发布
本文指导如何在Xilinx中自定义DDRIP的仿真工程，包括修改sim_tb_top.v以扩展内存空间，解决仿真停止问题，并处理Vlog警告。

1： 建立axi/非axi工程，右键点击ddr-ip，选择输出xilinx官方仿真工程

2：打开该工程

3： 将官方仿真模型文件和sim_tb_top.v拷贝走

4：修改sim_tb_top.v文件，把自己ddr读写的工程加入，替代原xilinx的example_top。即可仿真

5：原有例子仅仅可以仿真1024个内存空间，如果需要更多，需要修改如下地方：

parameter MEM_BITS         =     23+5;// 15; // Set this parameter to control how many write data bursts ca

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