SYNOPSYS AXI VIP using note

最新推荐文章于 2025-11-02 12:03:23 发布
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#AXI VIP #VIP

本文档介绍了如何利用SYNOPSYS AXI VIP搭建测试平台，重点涉及cust_svt_axi_system_configuration、cust_svt_axi_master_transaction及svt_axi_user_defines.sv的配置。此外，还提到了VIP的monitor，特别是其analysis_port中的item_observed_port，用于捕获并记录交易详情。
ref:https://solvnet.synopsys.com/dow_retrieve/latest/snps_vip_lib/doc/axi_svt_uvm_class_reference/html/index.html

1. testbench buildup   

关于 bench 可以选择两种方式，比如只需要 master agent: （下面的所有example都会以我的DUT是slave）
1. 单独 invoke master agent ，所以留给 user 的 configuration object 是 svt_axi_port_configuration

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【uart篇】synopsys uart vip配置使用
小白蒋-材料转行芯片验证
03-23 6617
作者：小白蒋 本文主要记录下，synopsys uart vip如何配置使用？ 首先是 uart_configuration.sv 文件，直接继承自 uart vip agent configuration; class uart_configuration extends svt_uart_agent_configuration; `uvm_object_utils(uart_confiration) function new(string name="uart_configuration");
AMBA VIP基础使用方式（AXI）
qq_37573794的博客
05-25 7660
AXI环境配置 1）基础配置 作为master或者slave使用时，对应的is_active = 1 只作为i监测（monitor)使用时，对应slave_cfg的is_active = 0（对应端口连接也有所区别） class smu_axi_cfg extends svt_axi_system_configuration; `uvm_object_utils(smu_aix_cfg) function new(string name="smu_axi_cfg); super.new(n..
synopsis axi vip user guide
08-07
synopsis axi vip user guide
SYNOPSYS DDR VIP use note
IC小白_calvin
07-13 4016
Based on version-2016.03/2016.06 (DDR2 looks like not stable & flexiable.。 2016.03 DDR2 VIP发现了很多bug，特别是一些AC timing和protocol的ERROR误报，所以项目进行到一半还好出了2016.06版) 1.vip路径问题        每一次generate vip,新产生的DDR_V
UVM验证框架模板项目实战详解
weixin_30336531的博客
11-02 649
UVM（Universal Verification Methodology）起源于OVM（Open Verification Methodology），由Accellera组织标准化后发展为当前IC验证领域的主流方法学。其设计初衷是解决传统定向测试在面对复杂SoC时验证效率低下、复用性差的问题。UVM通过引入受约束随机激励生成事务级建模和分层验证平台结构，实现了从“手写测试”向“自动化验证”的范式转变。尽管提供了通用框架，但在实际项目中必须根据具体协议定义派生类。
Synopsys AXI VIP 使用记录
ZhangShuHuai11的博客
12-17 2630
记录S家的AXI VIP使用时遇到的报错及解决方案。
Synopsys AXI VIP 安装使用
CHY_128的博客
03-05 5689
Synopsys VIP一般为.run文件形式，以AMBA VIP为例，VIP文件为vip_amba_svt_R-2020.12.runVCS版本T-2022.06，看有建议说VIP版本不能晚于VCS版本。
xilinx mig仿真 synopsys ddr vip使用
weixin_44745808的博客
09-19 1208
原本颗粒的速度等级是2400，工程中降频使用，实际跑的是2000。2.原本的test下是一个env，一个env里只包含一个memory_agent，对应一个ddr颗粒。生成后打开示例工程，然后导出仿真，直接运行脚本，这样就得到了所有设计相关的仿真库文件，都在仿真目录下的vcs_lib/xildefault_lib中。4.注释掉vip例子工程有关controller的所有代码，因为设计xilinx的例子工程里包含了控制器的axi侧的读写激励。ddr_null_virtual_sequence.sv代码。
S家的AXI vip使用记录
qq_40571921的博客
03-12 1万+
参考vip的example：/share/tools/eda1/synopsys/vip-2021.09/vip/svt/amba_svt/latest/examples/sverilog/tb_axi_svt_uvm_basic_active_passive_sys/env。set给apb_sys_env：uvm_config_db#(svt_apb_system_configuration)::set(this, "apb_sys_env", "cfg", apb_cfg);他们已经做好了归类了。
关于Synopsys AXI VIP中的SLAVE response的一些设置
m0_69999886的博客
03-12 4772
Synopsys AXI VIP slave response transaction顺序的一些设定
Synopsys AXI VIP wstrb相关
inthesun的博客
12-13 5497
使用AXI VIP发送transaction的时候，发现transaction的每个beat的wstrb按照右对齐的方式设置，而不需要按照axi协议规定的方式设置，就可以正确的发送。这是为什么？ 让我们先看看axi协议是怎么规定的 These equations determine which byte lanes to use for the first transfer in a burst:• Lower_Byte_Lane = Start_Address – (INT(Start_Address
apb_watchdog(Synopsys APB VIP配置)
m0_69999886的博客
12-28 2410
Synopsys apb vip配置watchdog模块
synopsys spi vip使用小结
hungtaowu的博客
09-26 3807
美光flash时序参数
Synopsys AXI VIP 解析（3）—— reorder和delay
CHY_128的博客
03-24 3414
VIP的reorder对应AXI的out of order机制，包括B和R通道乱序返回。
Synopsys验证VIP学习笔记（4）检查AXI的outstanding数
PoPo's Blog
11-04 9200
在使用AXI-VIP验证时，需要检查AXI的outstanding数，由于VIP的monitor port本身仅监测单笔burst，而outstanding涉及多笔burst，可以采用回调机制实现： 从 svt_axi_port_monitor_callback 类扩展用户自定义回调类 cust_svt_axi_monitor_callback。 class cust_svt_axi_monitor_callback extends svt_axi_port_monitor_callback ;
Synopsys AXI VIP（5）——寄存器模型
CHY_128的博客
07-03 739
本文介绍了如何将Synopsys AXI VIP与UVM寄存器模型结合使用。AXI VIP已内置adapter，可直接连接寄存器模型句柄，无需额外编写转换代码。示例展示了32位AXI存储寄存器模型的实现方法，包括RAL模型定义、环境配置以及测试用例中的前门和后门读写操作。
Synopsys验证VIP学习笔记（1）Memory模型用法
热门推荐
PoPo's Blog
09-09 1万+
Synopsys的VIP(本文以AXI slave为例)提供了由svt_mem类表示的momory模型，在passive模式下其观测值与寄存器模型类似，会基于总线更新，在active模式下则由slave sequence更新。
Xilinx AXI VIP使用教程
qq_40268672的博客
08-20 2237
Xilinx提供了用于验证AXI相关设计的AXI VIP（AXI Verification IP），它可以对自己设计的AXI接口模块进行全方位的验证（如使用VIP的Master、Passthrough、Slave三种模式对自己写的AXI接口进行仿真验证），提前规避和发现一些不满足AXI总线规范的设计问题。本文以Master AXI VIP为例，介绍其使用方法。
axi vip使用
oldmoney
08-31 414
AXI VIP的简单使用 Xilinx AXI VIP使用教程
synopsys axi vip检查数据
最新发布
11-19
Synopsys AXI VIP（AXI Verification IP）在验证AXI（Advanced eXtensible Interface）总线系统时，对于数据检查有多种方式。 #### 1. 内置的检查器 Synopsys AXI VIP 包含了一系列内置的检查器，这些检查器会自动对 AXI 协议的各个方面进行检查，包括数据传输的正确性。例如，在数据传输阶段，检查器会验证数据的宽度是否符合 AXI 协议的规定，数据的对齐是否正确等。当检测到不符合协议的情况时，会自动报告错误信息。 ```systemverilog // 示例代码展示如何使用内置检查器 import axi_vip_pkg::*; axi_vif vif(); axi_master_vip master_vip(vif); axi_slave_vip slave_vip(vif); initial begin master_vip.start(); slave_vip.start(); // 仿真过程中，内置检查器会自动工作 end ``` #### 2. 自定义检查逻辑 除了内置检查器，用户还可以编写自定义的检查逻辑来满足特定的验证需求。可以通过监听 AXI 接口上的信号，对数据进行额外的检查。例如，检查数据的范围是否在预期之内，数据的顺序是否正确等。 ```systemverilog // 示例代码展示自定义数据范围检查逻辑 always @(posedge vif.aclk) begin if (vif.wvalid && vif.wready) begin if (vif.wdata < 0 || vif.wdata > 1023) begin $error("Data out of expected range: %0d", vif.wdata); end end end ``` #### 3. 事务级检查 Synopsys AXI VIP 支持事务级的验证，用户可以通过监控事务的完成情况来检查数据。在事务完成后，可以获取事务中的数据，并进行进一步的分析和检查。 ```systemverilog // 示例代码展示事务级数据检查 axi_transaction trans; initial begin master_vip.get_transaction(trans); if (trans.data_check() == 0) begin $error("Data check failed in transaction"); end end ```
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