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在仿真时，寄存器的值可在任意时刻通过赋值操作进行改写。当执行完最后一条语句后，便再次执行语句块中的第一条语句，如此循环反复。拼接操作符用大括号 {，} 来表示，用于将多个操作数（向量）拼接成新的操作数（向量），信号间用逗号隔开。每个 initial 语句或 always 语句都会产生一个独立的控制流，执行时间都是从 0 时刻开始。initial 语句从 0 时刻开始执行，只执行一次，多个 initial 块之间是相互独立的。由于循环执行的特点，always 语句多用于仿真时钟的产生，信号行为的检测等。

d0 11d1 10d2 01d3 00。

Verilog入门练习题目