提示:文章写完后,目录可以自动生成,如何生成可参考右边的帮助文档
前言
分频器往往会使用计数器以及组合逻辑来完成分频,以下是对于计数器的学习和相关分频器如何设计;
一、计数器
计数器主要注意的就是时序逻辑与组合逻辑分开写,这样符合RTL设计代码规范
例:10进制的计数器
module counter_10(
input clk,
input rst_n,
output q);
//时序部分
always@(posedge clk or negedge rst_n)begin
if(!rst_n)
q<='d0;
else if(end_counter==1'b1)begin
q<=q+1'b1;
end
end
//组合逻辑
assign end_counter=(q<=9)?1'b1:1'b0;
endmodule

本文详细介绍了数字电路中计数器和分频器的应用。首先讲解了计数器的基本原理,以10进制计数器为例展示代码实现。接着,讨论了不同类型的分频器设计,包括偶数分频、奇数分频以及小数分频。对于奇数分频,区分了无占空比要求和保持50%占空比的实现方式。最后,提到了通过组合分频器实现小数分频的方法,并给出了1000Hz到1Hz分频的示例。整体内容深入浅出,适合数字电路学习者参考。
最低0.47元/天 解锁文章
2119

被折叠的 条评论
为什么被折叠?



