分享的17条Linux命令

超级详细!!!新手使用AutoDL跑深度学习(MixVPR项目)的学习记录 新手第一次在AutoDL上跑深度学习的实验,遇到一些问题,简单记录一下。如果大家发现问题,欢迎和我讨论。 阅读详情

\1. 按oracleSID来查询连接数据库的客户端IP Linux命令

  • netstat -anpT | grep oracleSID | awk '{print $5}' | grep -o -E  '1.*:' | awk -F ':' '{print $1}' | sort

\2. 按监听端口1521来查询连接数据库的客户端IP

  • netstat -anpT | grep 1521 | awk '{print $5}' | grep -o -E  '1.*:' | awk -F ':' '{print $1}' | sort

\3. 杀掉数据库服务器上连接数据库oracleSID的客户端的进程

  • kill -9 `ps -ef | grep oracleSID | grep LOCAL=NO | grep -v grep | awk '{print $2}'`

\4. 删掉某个用户userA下面的所有进程

  • pkill -9 -u userA

\5. 查询连接1521端口的process进程数

  • netstat -pan |grep 1521 |wc -l

\6. 查询来自某台服务器192.168.21.15的连接的process进程数

  • netstat -pan |grep  192.168.21.15 |wc -l

\7. 汇总连接1521端口的每个客户端IP的连接数

netstat -apnT|grep 1521 |awk  '{print $5}'|sort -u |grep -v 1521 |grep -v '*' |awk -F ':'  '{print $4}'|uniq -c |sort -nrnetstat -anpT|grep 1521 |awk  '{print $5}'|grep -o -E  '1.*:' |awk -F ':' '{print $1}' | sort |uniq -c |sort -nr

\8. 显示前10个占用空间最大的文件或目录

  • du -s * | sort -nr | head

\9. 统计某一天的所有文件的总量大小

  • ls --full-time `find ./* -name "log_*.bak"` | grep '2016-05-09' | awk '{print $9}' | xargs du -ck
    



\10. 删除几天前的文件 



- 
- 

find /mitac/mds/arch/ -ctime +150 -exec rm -rf {} ;--常用 find /mitac/mds/arch/ -name '*836701255.dbf' -ctime +150 -exec rm -rf {} ;--删除以836701255.dbf结尾,150天前被修改过的文件




\11. CPU占用最多的前10个进程: 



- 

ps auxw|head -1;ps auxw|sort -rn -k3|head -10




\12. 内存消耗最多的前10个进程 



- 

ps auxw|head -1;ps auxw|sort -rn -k4|head -10




 \13. 虚拟内存使用最多的前10个进程 



- 
- 

ps auxw|head -1;ps auxw|sort -rn -k5|head -10 top后按1,可以看到多少个cpu,按shift+p则按cpu排序,按shift+m则按内存排序




\14. vi替换所有字符串,如下把1都换成2



- 

:%s/1/2/g




\15. 查看IO信息,如下 每1秒显示一次,一共显示3次,显示为MB



- 

iostat -d -x -m 1 3




\16. 查看cp一个文件file1到/u01目录下需要多长时间



- 

time cp file1 /u01/




\17. 查看CPU某段时间比如7:00到9:00期间的使用率



- 

sar -s 07:00:00 -e 10:00:00

```

以上就是良许教程网为各位朋友分享的17条Linux命令。 以上就是良许教程网为各位朋友分享的Linux相关知识。

基于FPGA的CORDIC算法实现——Verilog版 目前,学习与开发FPGA的程序员们大多使用的是Verilog HDL语言(以下简称为Verilog),关于Verilog的诸多优点一休哥就不多介绍了,在此,我们将重点放在Verilog的运算操作上。 我们都知道,在Verilog中,运算一般分为逻辑运算(与或非等)与算术运算(加减乘除等)。而在一开始学习Verilog时,老司机一定会提醒我们,“切记,千万别用‘/’除、‘%’取模(有的也叫取余)和‘ 阅读详情

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码农在线QY
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