FPGA优质开源项目 - UDP RGMII千兆以太网

本文介绍一个FPGA开源项目：UDP RGMII千兆以太网通信。该项目在我之前的工作中主要是用于FPGA和电脑端之间进行图像数据传输。本文简要介绍一下该项目的千兆以太网通信方案、以太网IP核的使用以及Vivado工程源代码结构。

Vivado 的 Tri Mode Ethernet MAC IP核需要付费才能使用，因此本文提供完整工程源码。文章末尾有该工程源码获取方式，有需要的小伙伴可以收藏、分享一下。

一、软硬件平台

• 软件平台：Vivado 2017.4;

• 硬件平台：XC7K410TFFG900-2;

二、RGMII接口

本设计采用 RGMII 接口的 88E1512 芯片。RGMII 接口的主要优势在于，它可以同时适用于1000M、100M、10M三种速率，并且接口占用引脚数较少。

RGMII 使用 4bit 数据接口采用上下沿 DDR（Double Data Rate）的方式在一个时钟周期内传输 8bit 数据信号，即上升沿发送或者接收数据的低4位[3:0]，下降沿发送或者接收数据的高4位[7:4]。同理，使用 1bit 控制接口采用 DDR 的方式在一个时钟周期内传输 2bit 控制信号。

• 发送端：tx_clk，tx_d[3:0]，tx_ctrl；

• 接收端：rx_clk，rx_d[3:0]，rx_ctrl；

• 三种速率模式

RGMII 接口适用于1000M、100M、10M三种传输速率。

当工作于1000M时，时钟信号TXC和RXC均为 125MHz，4bit数据信号上下沿值均有效，控制信号上下沿