makefile $* $^....

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#makefile

于 2020-04-27 14:51:57 首次发布

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本文详细解析了使用GCC编译器时Makefile的编写方法，通过具体示例展示了目标文件与依赖文件的关系，以及如何利用Makefile进行自动化编译。

$* 不包含扩展名的目标文件名称
$+ 所有的依赖文件，以空格分开，并以出现的先后为序，可能包含重复的依赖文件
$< 第一个依赖文件的名称
$@ 目标文件的完整名称
$^ 所有不重复的依赖文件，以空格分开
$% 如果目标是归档成员，则该变量表示目标的归档成员名称


hello:hello.o
Gcc hello.o -o hello
hello.o:hello.c hello.h 
Gcc -c hello.c -o hello.o

OBJS :=hello.o
CC :=Gcc
hello:$(OBJS)
$(CC) $^ -o $@

OBJS1 :=hello.o
OBJS2 :=hello.c hello.h
CC :=Gcc
hello:$(OBJS1)
$(CC) $^ -o $@
$(OBJS1):$(OBJS2)
$(CC) -c $< -o $@