对于camera调试中PCLK的计算

LCD基础概念(三):LCD RGB之PCLK、VS、HS、DE RGB之PCLK、VS、HS、DE 1.Pixel clock像素时钟 Pixel clock,也叫RGB clock,也叫Dot clock,一般会简写为pclk。 只要是数字信号处理电路,就必须有时钟信号。在液晶面板中,像素时钟是一个非常重要的时钟信号。像素时钟信号的频率与液晶面板的分辨率有关,分辨率越高,像素时钟信号的频率也越高。 无论对TTL接口液晶面板,还是对LVDS接口面板,像素时钟信号都有两方面作用: 指挥RGB信号按顺序传输,数字RGB信号在像素时钟信号的作用下,按照一定的顺序,由驱动板 阅读详情
AI摘要

本文详细介绍了PAL和NTSC信号中像素时钟(PCLK)的计算方法,并深入解析了BT656格式下每行数据的具体组成,包括起始码(SAV)、结束码(EAV)、水平消隐以及有效数据等内容。

PCLK即 pixclk,像素时钟信号

对于PAL信号和NTSC信号,两者PCLK分别为27M和27.2M,

计算公式如下:

1728*625*25=27000000

1728*525*30=27216000


其中1728=720*2+8+280

下面摘自别人的 BT656一行数据的组成

每一行的组成(Lines)

    下面说明每一行的组成,一行是由4个部分组成:

    行 = 结束码(EAV) + 水平消隐(Horizontal Vertical Blanking) + 起始码(SAV) + 有效数据(Active Video)

    典型的一行数据组成如下图所示:

    起始码(SAV)和结束码(EAV),它是标志着一行的开始结束的重要标记,也包含了其他的一些重要的信息,后面将会讲到。

    为什么水平消隐 是280字节,这个我暂时还没搞清楚,不知道是不是标准定义的。

    为什么一行中的有效数据是 1440 字节? 因为PAL制式的SDTV或者D1的分辨率为 720*576,即一行有720个有效点,由于采集的是彩色图像,那么一行就是由亮度信息(Y)和色差信息(CbCr)组成的,由于是 YCbCr422格式,故一行中有720列Y,720列CbCr,这样,一行的有效字节数就自然为 720 x 2 = 1440 字节了。


从上面可以看出BT656格式的数据一行组成需要1728字节,然后PAL有625行,NTSC有525行,两种制式的数据刷新频率分别是25HZ和30HZ

这样更新一个像素点需要的时钟即为刚开始写的,

PAL:1728*625*25=27000000 HZ

NTSC:1728*525*30=27216000 HZ


WDT中的pclk及相关单位换算 PCLK (Peripheral Clock) cycles 指的是在微控制器或微处理器系统中由外设时钟(PCLK)产生的时钟周期数。PCLK 是驱动系统中外设的时钟信号,例如定时器、UART、SPI 等。PCLK 周期的长度取决于时钟频率和系统中使用的外设类型。在编程时,可以使用 PCLK 周期来计算各种时间参数,如定时器的时间间隔、UART 通信的波特率等。 阅读详情

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