FPGA之分频器

本文详细介绍了分频器的工作原理及其在数字电路中的应用。通过具体的二分频和六分频实例,展示了如何使用Verilog HDL进行分频器的设计与实现。深入解析了分频过程中的计数器状态转换,为读者提供了实用的数字电路设计技巧。

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分频器的作用是将已知信号频率进行分频,根据频率大小实现不同频率间信号的转换。

例子:设计一个二分频

分析:信号:clk、clk_2,实现过程,clk经过两次,clk_2输出一次

module div_2(clk,clk_2);
   input clk;
   output  clk_2;
   reg clk_2;
   reg count;
always@(posedge clk)
 begin
      clk_2=~clk_2;
  end
endmodule

如果是6分频则是一个周期=6个clk周期,

reg[1:0] count
always @(posedge clk)
    begin
     if(count==2'b10)
      count<=2'b0;
      clk_3<=~clk_6;
     else
      count<=count+2'b1;

 

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