源同步输入时序分析（十一）

原创 已于 2025-10-19 00:16:29 修改 · 202 阅读 · 0 ·
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于 2025-10-18 23:02:33 首次发布

源同步输入中心对齐时序分析

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前言

对于系统同步分析时，外部clk会抵消，因此之后数据延迟，只需要计算上一个时钟和捕获沿之间的数据延迟即可。对于源同步，则数据相对于时钟沿是可能左右漂移，因此，分析上发起沿和捕获沿之间，数据的延迟关系。对于有锁相环的，会进行时钟相位补齐，因此只计算偏移即可
对于系统同步，数据肯定是延迟于时钟沿
对于源同步，则左右偏移
对于中心对齐，则数据是中间

1.

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对于中心对齐，就以上升沿为标准，计算中心点左右偏移的情况，来进行约束（边沿对齐，则以数据end的位置进行偏差计算）

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在分析时，自己画一个下图绿色的框去移动就知道延迟如何计算了，后面的文章也是如此，画一个框即可理解

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注意这里是和数据的开始对齐

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锁相环会调整补偿，所以只分析左右移动

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