【数字IC刷题】专栏内容导航

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分类专栏： # 数字IC笔试刷题 文章标签： 华为 面试
于 2024-08-28 23:14:15 首次发布
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【数字IC验证】博客内容全览
MoorePlus的博客
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以真题及面试为基础，总结各大IC公司笔试以及面试中的常考、常问知识点！（数字IC前端设计、验证都可使用）笔试及面试中常考知识点、手撕代码总结常见面试问题总结（七、常见总线协议篇）常见面试问题总结（六、项目篇）常见面试问题总结（五、验证策略及宏观思想篇）常见面试问题总结（四、UVM篇）常见面试问题总结（三、SystemVerilog篇）常见面试问题总结（二、数字电路与Verilog篇）常见面试问题总结（一、EDA工具及IC整体设计流程篇）
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00-华为hi3798mv100刷NAS
动感小麦兜的博客
11-23 512
在文件夹中输入\\192.168.31.XX（前面找到的电视盒子的IP），即可以看到download文件夹，这个就是NAS共享的文件夹，可以把一些文件放到这个里面。将USB转TTL的TX、RX、GND引脚连接到电视盒子（需要注意TX及RX的顺序，即USB端的TX接电视盒子的RX，USB端的RX接电视盒子的TX）但是，我这个电视盒子对短接孔的方式不起作用，依旧跑到电视盒子的主程序中，没法触发刷写。根据自身的型号选择对应的刷机包，我这里的型号是1g版本，下载下图两个包，分别解压。如何获取电视盒子的IP？
谷歌正式跟进苹果PCC，华为OPPO同步入局：边缘AI隐私战打响
边缘计算社区
11-22 996
虽然不是所有厂商都能像谷歌、华为、苹果那样，实现从云到端的软硬件全链路自主可控，但"平衡大模型性能与隐私安全"的方向，已经明确了。据彭博社报道，苹果计划每年花10亿美元，获得谷歌Gemini模型的使用权，让它在PCC平台上运行，来支撑Apple Intelligence。从数据中心的TPU和Gemini大模型，到终端的Tensor芯片和Android系统，谷歌在整个AI体验链上都有自己的技术。边缘AI的下半场，或许不在于谁的模型更大，而在于谁能让用户在用AI的时候，不用担心隐私泄露。
HarmonyOS在智能穿戴中的Huawei Watch
2509_93946184的博客
11-25 224
但搭载HarmonyOS的Huawei Watch GT 4能独立运行应用，比如在操场跑步时，手机放办公室，手表照样记录轨迹、播放本地音乐，甚至通过eSIM接打电话。最实用的是导航流转，手机上设好目的地，抬手就能在手表上看路线，骑车时特别方便。但整体来看，HarmonyOS让智能手表找到了自己的定位——它不是手机的替代品，而是更适合特定场景的智能伴侣。站在智能穿戴发展的十字路口，华为Watch展现了一条不一样的技术路径——不追求功能的堆砌，而是通过系统级优化，让每个功能都恰到好处。
HarmonyOS在智能车载中的Huawei Drive
2509_93946281的博客
11-25 299
在实际架构中，与车辆总线通信的控制器运行着经过功能安全认证的实时系统，而中控屏等设备则运行着功能丰富的HarmonyOS。体验HarmonyOS在车载场景的这些天，最大的感触是：真正的智能不是堆砌功能，而是让技术隐形。得益于HarmonyOS的开放生态，车载场景的应用边界不断拓展。你可以用智能手表解锁车辆，家里的智能窗帘会在你开车到家前自动关闭，甚至充电桩可以根据你的行车轨迹智能安排充电时间。手机收到的餐厅地址，上车时自动推送到车机导航——这些场景的实现，都得益于HarmonyOS的原子化服务架构。
HarmonyOS在智能家居中的Huawei
2509_93946088的博客
11-25 436
其中，“1”是指手机作为主入口，“8”包括PC、平板、智慧屏等辅入口，而“N”则是泛IoT设备，覆盖智能家居的方方面面。具体到智能家居场景，搭载HarmonyOS的手机、平板、智慧屏等设备可以自动发现并连接周围的智能家电。通过分布式软总线技术，它打破了单物理设备的硬件边界，让多个设备能够自由组合、能力互助，形成一个个“超级终端”。相比其他系统，HarmonyOS的微内核设计大幅减少了代码量，从源头降低了安全漏洞风险，这对于需要处理大量用户隐私数据的智能家居环境尤为重要。
HarmonyOS在智能家居中的华为生态
2509_93946509的博客
11-25 419
你的手机、平板、手表，乃至家里的冰箱、空调，都不再是信息孤岛，而是变成了一个超级终端的不同部分。你手机上正在播放的音乐，无需复杂的配对操作，可以直接“甩”到智慧屏或者音箱上继续播放，这个过程几乎感觉不到顿挫，就是这种能力最直观的体现。紧接着，走廊的灯自动亮起，客厅的窗帘缓缓拉开，空调调整到舒适的温度，音响开始播放你设定的欢迎音乐……我们看到市场上支持HarmonyOS Connect的设备品类越来越多，从传统的黑白电到像健身镜、料理机这样的新兴品类，生态的丰富性正在形成强大的网络效应。
HarmonyOS在智能车载中的Huawei HiCar
2509_93948268的博客
11-25 282
HiCar的本质是HarmonyOS分布式能力在车载场景的具象化。当用户携带搭载HarmonyOS的手机进入车辆，系统自动识别驾驶场景，将手机的计算能力、AI算法与车机屏幕、音响、麦克风等硬件资源重组。CarPlay如同将手机界面投影到车机屏幕，而HiCar则让手机化身车机的协处理器——例如在复杂路况渲染时，手机GPU协助车机完成3D地图绘制，解决传统车机芯片算力不足的痛点。当方向盘成为数字世界的旋转枢纽，或许我们追求的从来不是更炫酷的屏幕，而是那种恰到好处的、与驾驶场景共呼吸的智能陪伴。
HarmonyOS在智能家居中的Huawei Link
2509_93946182的博客
11-25 429
后来拆解源码发现，这套机制靠的是跨设备数据同步协议，每个设备都维护着相同的数据副本，当某个节点数据变更时，其他设备会通过增量同步方式更新，比走云端轮询效率提升近十倍。后来通过Huawei Link的设备虚拟化功能，把红外指令库按品牌型号做成可加载的驱动模块，系统会自动匹配最接近的控制方案。周末看电影时对着智能屏说“开启影院模式”，这个语音指令会通过Huawei Link的语义理解引擎拆解成多个原子指令：电视自动降低亮度至30%，功放切换至杜比音效，窗帘闭合度调整至85%，所有动作在1.2秒内并行执行。
HarmonyOS在智能车载中的Huawei智慧座舱
2509_93946938的博客
11-25 416
桌面卡片式的布局允许用户自定义，将最需要的服务，如音乐、导航、车辆状态等，置于首页，实现零层级操作。同时，结合精准的声场定位技术，可以实现“音随人动”的效果，例如语音助手与驾驶者的对话声，会模拟从正前方传来的空间感，营造更真实、更少干扰的交互体验。HarmonyOS赋能下的华为智慧座舱，不仅仅是信息娱乐系统的升级，更是一次对智能汽车“灵魂”的重塑。随着HarmonyOS生态的不断繁荣和技术的持续迭代，未来的智慧座舱，必将带来更多超越想象的便捷与乐趣，引领我们驶向更加智能化的出行未来。
华为数据中心CE系列交换机级联M-LAG配置示例
最新发布
2509_94198662的博客
11-25 443
同时“Causation”的状态是“-”，Node 1的“Port State”状态为“Up”，Node 2的“Port State”状态为“Up”，且Node 1和Node 2的M-LAG状态均为“active”，表明M-LAG的配置正确。在配置M-LAG之前，我们需要确认交换机的型号是否支持M-LAG，如数据中心交换机CE58、CE68、CE88、CE98等等交换机都支持M-LAG技术。通过以上配置步骤，就可以在华为CE交换机上成功配置M-LAG，提高网络的可靠性和稳定性。1，配置SwitchA。
HarmonyOS在智能家居中的Huawei HarmonyOS
2509_93945959的博客
11-25 411
更厉害的是，在控制中心的超级终端界面，周围所有的鸿蒙设备都会以气泡的形式显示，你只需要通过拖拽的方式，让两个设备的气泡碰在一起，就能完成组合联动。虽然前路漫漫，挑战不少，但至少它指明了一个方向：未来的智能家居，不应该是一盘散沙，而应该是一个有机的整体，一个真正懂你、无缝服务你的“超级终端”。但在鸿蒙的分布式体系下，手机和电视之间建立了一个虚拟的“共同设备”，手机的显示能力可以直接被电视调用，视频流无需经过手机解码再传输，而是由系统智能分配，让电视直接从云端或手机拉取数据并播放，手机甚至可以变成遥控器。
数字IC验证makefile学习内容
06-21
<think>我们正在讨论数字IC验证中Makefile的使用方法和内容。用户之前询问了VCS两步法和三步法的区别，现在转向Makefile的学习。根据引用，用户提到的专栏文章中有关于Makefile在Questasim和VCS中运用的实例，因此我们可以以此为切入点。目标：提供数字IC验证中Makefile的学习教程、使用方法和内容详解。结构计划：1.介绍Makefile在数字IC验证中的作用和重要性。2.讲解Makefile的基本语法和常用规则。3.提供在VCS和Questasim中使用的Makefile实例。4.解释如何利用Makefile管理验证流程（编译、仿真、清理等）。5.讨论Makefile的高级用法（如变量、条件判断、函数等）在验证中的实际应用。6.提供学习资源和进一步学习的建议。注意：用户是数字IC验证的学习者，可能对Makefile有一定了解，但需要具体到验证环境的应用。我们将按照以下步骤展开：-为什么在验证中使用Makefile？-Makefile基础（针对验证工程师需要掌握的部分）-实例：VCS和Questasim的Makefile-高级用法和技巧-总结和学习建议同时，根据系统指令，在适当的地方使用数学公式（如果有的话）和代码块，并在最后生成相关问题。</think>### 数字IC验证中Makefile使用详解 Makefile是数字IC验证的核心自动化工具，可高效管理VCS/Questasim等EDA工具的编译、仿真和报告流程。以下结合实例详解其应用方法： --- #### **一、Makefile核心优势** 1. **自动化验证流程** - 一键执行编译→仿真→覆盖率收集→报告生成 - 避免重复输入复杂EDA命令 2. **增量编译优化** - 仅重编译修改的RTL文件，加速验证迭代 - 特别适合大型SoC项目（三步法流程） 3. **跨平台支持** - 统一管理VCS/Questasim等工具命令 - 适配Linux/Unix开发环境 --- #### **二、Makefile基础语法** ```makefile # 定义变量（避免硬编码） TOOL = vcs # 仿真工具 SRC = top.v adder.v tb.sv # 源文件列表 COV_OPTS = -cm line+cond+fsm # 覆盖率选项 # 核心规则：编译→仿真→报告 all: compile sim report compile: $(TOOL) -sverilog $(SRC) $(COV_OPTS) -o simv sim: ./simv +UVM_TESTNAME=base_test report: urg -dir simv.vdb -report coverage clean: rm -rf simv* csrc *.vdb # 清理中间文件 ``` --- #### **三、验证流程自动化实例** ##### **1. VCS三步法自动化** ```makefile ANDB_DIR = ./an_db # ANDB中间库路径 vlogan: vlogan -work $(ANDB_DIR) design.sv vhdlan -work $(ANDB_DIR) entity.vhd vcs: vlogan vcs -debug -cm cov_func $(ANDB_DIR)/top sim: vcs ./simv -ucli -i dump_wave.tcl ``` ##### **2. 覆盖率驱动的回归测试** ```makefile # 定义测试用例列表 TESTS = test1 test2 test3 regression: $(TESTS) $(TESTS): vcs -sverilog test_$@.sv -o simv_$@ ./simv_$@ -cm_dir cov_$@ urg -dir cov_$@ -report report_$@ ``` ##### **3. Questasim流程控制** ```makefile compile: vlib work vlog -sv design.sv tb.sv sim: compile vsim -c -do "run -all; quit" tb_top wave: vsim -view wave.wlf # 波形查看 ``` --- #### **四、高级技巧与最佳实践** 1. **条件分支** ```makefile ifeq ($(DEBUG),1) OPTIONS += +define+DEBUG=1 endif ``` 2. **文件依赖检测** ```makefile simv: $(SRC) vcs $^ ``` 3. **并行执行加速** ```bash make -j 4 regression # 并行执行4个测试用例 ``` 4. **动态参数传递** ```bash make sim TEST=ahb_burst_test # 命令行指定测试用例 ``` --- #### **五、学习路径建议** 1. **基础语法** - 掌握`目标-依赖-命令`结构（[示例代码](#二makefile基础语法)） - 理解变量定义（`=`, `:=`, `?=`的区别） 2. **验证专用扩展** - 学习EDA工具命令集成（VCS/Questasim编译选项） - 掌握覆盖率报告自动化流程 3. **调试技巧** - 使用`make -n`预览执行命令 - 添加`@echo`打印调试信息 > **关键参考**： > - 专栏文章《Makefile在Questasim和VCS中的运用实例》详细解析EDA集成方法[^1] > - 数字验证工程师需精通自动化脚本编写能力[^2] --- ### 相关问题 1. 如何在Makefile中实现VCS增量编译（仅重编译修改模块）？ 2. Makefile如何管理跨语言（Verilog+VHDL）项目的混合编译流程？ 3. 在回归测试中，如何用Makefile自动合并多个测试的覆盖率？ 4. Makefile并行执行（`-j`参数）有哪些注意事项？
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