基于Quartus-ll的1位全加器的设计

最新推荐文章于 2025-03-04 20:04:35 发布
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本文链接：https://blog.youkuaiyun.com/Mjing11/article/details/115522702
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本文档详细介绍了如何使用Quartus II 工具进行1位全加器的设计，包括原理图输入和Verilog编程。首先通过新建工程，创建半加器的原理图文件，并进行仿真验证。接着，设计全加器的顶层文件，将半加器作为模块调用。在Verilog编程部分，编写了全加器的代码并完成编译下载过程。

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文章目录

一、原理图输入

新建工程
File→New Project Wizard
点击next到下图：
在这里插入图片描述
选择保存路径，输入工程名。
选择芯片：
在这里插入图片描述
然后一直next，直到最后点击Finish。

1.1、创建半加器原理图文件

1、新建文件
在这里插入图片描述
2、在编辑窗中调入元件，完成半加器的原理图输入
直接双击空白处，从Symbol窗中选择需要的符号，或者直接在name文本框中输入元件名，在这里需要and2，xor，然后时输入输出管脚，连好电路。
在这里插入图片描述
在这里插入图片描述
3、存盘编译
File→Sa

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