以太网PHY 芯片之 MII/MDIO接口详解

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本文详细解析了MII/RMII/SMII及GMII/RGMII/SGMII接口的信号定义，并探讨了相关知识。同时，对RJ-45接口进行了总结，分析了10/100模式和1000M模式下的设计方法。

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原文链接：http://www.cnblogs.com/touchblue/p/3535576.html


本文主要分析MII/RMII/SMII，以及GMII/RGMII/SGMII接口的信号定义，及相关知识，同时本文也对RJ-45接口进行了总结，分析了在10/100模式下和1000M模式下的设计方法。
Network 之二 Ethernet（以太网）中的 MAC、MII、PHY 详解
技术干货
04-26 16万+
结构   从硬件的角度看，以太网接口电路主要由MAC（Media Access Control）控制器和物理层接口PHY（Physical Layer，PHY）两大部分构成。如下图所示   但是，在实际的设计中，以上三部分并不一定独立分开的。 由于，PHY整合了大量模拟硬件，而MAC是典型的全数字器件。考虑到芯片面积及模拟/数字混合架构的原因，通常，将MAC集成进微控制器而将PHY留在片外...
以太网接口MII 和 RMII
qq_37255138的博客
09-20 1729
连接以太网MAC和PHY设备的标准化方法。由 IEEE 802.3 标准定义。促进MAC（数据传输）和PHY（物理传输介质）之间的通信。
以太网详解二
肥嘟嘟的左卫门
09-15 5976
结构   从硬件的角度看，以太网接口电路主要由MAC（Media Access Control）控制器和物理层接口PHY（Physical Layer，PHY）两大部分构成。如下图所示   但是，在实际的设计中，以上三部分并不一定独立分开的。 由于，PHY整合了大量模拟硬件，而MAC是典型的全数字器件。考虑到芯片面积及模拟/数字混合架构的原因，通常，将MAC集成进微控制器而将PHY留在片外。更灵活、密度更高的芯片技术已经可以实现MAC和PHY的单芯片整合。可分为下列几种类型: CPU集成MAC与PHY。
PHY芯片UTP接口直连设计
12-06
浅谈 PHY 芯片 UTP 接口直连（不使用变压器）的设计 UTP 接口分为两种：电压驱动型和电流驱 动型，两种驱动方式决定了使用不同的变压器抽头。 本文对两种方式的有变压器和无变压器接法作了探讨，比较实用，与大家分享。
一文了解以太网 MAC、PHY 及对应芯片
最新发布
Amateur6的博客
06-13 1504
以太网接口电路由MAC控制器和PHY物理层构成，两者通常分别集成在微控制器和独立芯片中，也可实现单芯片整合。MAC负责数据链路层功能，PHY实现物理层功能，通过MII接口连接。MAC芯片如CH394集成协议栈固件，PHY芯片如CH182支持多种接口标准。随着技术发展，MAC和PHY可灵活组合，在OSI模型中协同完成数据通信任务。该设计兼顾芯片面积和功能需求，提供多种低成本、低功耗的工业级解决方案。
笔记——PHY芯片（以太网）设计
m0_57189965的博客
07-23 1万+
PHY芯片的设计
PHY管理接口简介
乐于分享
05-26 2151
以太网传输速率从10兆发展到今天的100G，MAC层和PHY层之间的硬件接口发生了很大的变化，但是其中用来管理PHY的物理引脚始终只有2个，即MDC和MDIO引脚。随着PHY层变得越来越复杂，PHY寄存器的组织方式和寻址方式发生了变化，PHY管理接口的名称也从“MII管理接口”变为“MDIO接口”。千兆以太网之前，PHY管理接口称为“MII管理接口”；从10G以太网开始使用“MDIO接口”。有的千兆和百兆PHY支持一些扩展功能，也需要使用MDIO接口进行管理。 MII管理接口和MDIO接口 ...
以太网 串行管理接口 SMI MDIO
烽火yes
12-30 2310
SMI接口包括两根信号线：MDC和MDIO，通过它，MAC层芯片（或其它控制芯片）可以访问物理层芯片的寄存器（前面100M物理层芯片中介绍的寄存器组，但不仅限于100M物理层芯片，10M物理层芯片也可以拥有这些寄存器），并通过这些寄存器来对物理层芯片进行控制和管理。SMI管理接口如下： 　　MDC：管理接口的时钟，它是一个非周期信号，信号的最小周期（实际是正电平时间和负电平时间之和）为4
SOC内部集成网络MAC外设+ PHY网络芯片方案：MII/RMII 接口与 MDIO 接口
wojiaxiaohuang2014的博客
03-31 2152
SOC内部集成网络MAC外设+ PHY网络芯片方案：MII/RMII 接口与 MDIO 接口
以太网详解（一）-MAC/PHY/MII/RMII/GMII/RGMII基本介绍
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sternlycore的博客
04-07 12万+
网络设备中肯定离开不MAC和PHY，本篇文章将详细介绍下以太网中一些常见术语与接口。 MAC和PHY结构 从硬件角度来看以太网是由CPU，MAC，PHY三部分组成的，如下图示意： 上图中DMA集成在CPU，CPU,MAC,PHY并不是集成在同一个芯片内，由于PHY包含大量模拟器件，而MAC是典型的数字电路，考虑到芯片面积及模拟/数字混合架构的原因，**将MAC集成进CPU而将PHY留在片外，这种...
MII/MDC接口详解：MAC与PHY的连接技术
"MAC接口中的MII_MDC详解，包括MII、RMII、SMII、GMII、RGMII、SGMII接口的信号定义和相关知识，以及RJ-45接口的设计分析。" 在计算机网络硬件设计中，MAC（Media Access Control）接口是连接网络设备物理层（PHY）...
STM32以太网电路设计：时钟电路与MII/RMII接口详解
由于以太网需要25MHz的时钟来驱动MII接口，而在10Mbps速率下，PHY会将该时钟分频至2.5MHz。确保时钟的稳定性和精确同步对于数据传输的正确性至关重要。设计时需要考虑噪声抑制、时钟抖动、电源稳定性等因素，以保证...
以太网PHY基本介绍
08-23
介绍了以太网PHY，以及PHY的一些基本功能和实例。
【以太网通信】MDIO 管理接口及控制器设计
洋洋Young的博客
09-09 2875
MDIO 管理接口是以太网 MAC 和 PHY 之间的接口，用于管理/配置以太网PHY 芯片。本文主要介绍 MDIO 管理接口定义，以及 MDIO 控制器设计。
以太网基础之PHY芯片理解
styyds的博客
12-11 4158
PHY在发送数据的时候，收到MAC过来的数据（对PHY来说，没有帧的概念，对它来说，都是数据而不管什么地址，数据还是CRC），每4bit就增加1bit的检错码，然后把并行数据转化为串行流数据，再按照物理层的编码规则(4B/5B编码)把数据编码，再变为模拟信号把数据送出去。这个随机时间很有讲究的，并不是一个常数，在不同的时刻计算出来的随机时间都是不同的，而且有多重算法来应付出现概率很低的同两台主机之间的第二次冲突。在 1000Mbps 传输速率下，时钟频率为 125Mhz，在时钟的上下沿同时采样数据。
千兆以太网（二）——MDIO接口协议
q1594的博客
08-29 1万+
MAC和PHY芯片有一个配置接口，即MDIO接口。可以配置PHY芯片的工作模式以及获取PHY芯片的状态信息。PHY芯片内部有一系列寄存器。用户通过配置寄存器来配置PHY芯片的工作模式。FPGA通过MDIO接口对PHY芯片的内部寄存器进行配置。通常情况下芯片在默认情况下也可以工作，即配置芯片不是必须的。也可通过外接特殊引脚的方式来配置PHY芯片的工作模式。...
【科普】一文读懂以太网PHY芯片
weixin_43381663的博客
07-22 2万+
PHY物理层器件应满足CSMA/CD以太网ISO/IEC 8802-3的标准要求。前面分别详细描述了MII接口、物理编码子层(PCS)、物理介质连接子层(PMA)、物理介质相关子层(PMD)以及自动协商(Auto-Negotiation)功能和原理。现将各部分功能概括于表4之中，以进行比较。表4 以太网物理层PHY芯片功能表MIIPCSPMATP-PMDAUTONEGMDI接MAC/PHY端口；接STA/PHY管理端口4B/5B编译码碰撞检测；串并转换；
协议篇-MDIO协议 深入解析MDIO
weixin_51418325的博客
07-19 9720
MDC/MDIO，英文全称Management Data Clock和Management Data Input/Output，主要被应用于以太网的MAC和PHY层之间，用于MAC层器件通过读写寄存器来实现对PHY层器件的操作与管理。
PHY芯片快速深度理解
嵌入式与人工智能
06-23 7901
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