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RSS订阅原创 FPGA知识基础之--uart串口通信协议，附RTL和Testbench代码
通信方式是指通信双方之间的工作方式或信号传输方式。它涉及终端与其他设备（如其他终端、计算机和外部设备等）之间通过数据传输进行的通信。通信方式的选择取决于多种因素，包括传输距离、传输速度、成本以及通信环境的特性等。UART是一种串行、异步、全双工的通信协议，用于在计算机和外部设备之间以串行方式传输数据。它支持异步通信，即发送端和接收端的时钟源可以不同，通过起始位和停止位来同步数据的发送和接收。
2024-08-16 15:16:53
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原创 FPGA知识基础之--FIFO ip核的使用以及实例化clocking wizard ip产生一个异步FIFO，附RTL和仿真代码
FIFO是一种先进先出的数据缓存队列，主要特点是数据顺序写入，再按照同样的顺序输出数据，即先进去的数据先被取出来。
2024-08-09 10:33:37
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原创 FPGA知识基础之--存储器知识点总结以及基于ip核的简单双端口RAM的实现和仿真（附RTL代码和Testbench代码）
笔者在最近的存储器学习时，遇到了一些问题，为此笔者用本篇博客来记录一下有关存储器的一些知识点。
2024-08-07 18:47:39
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原创 FPGA知识基础之RAM--基于IP核的单端口RAM设计
RAM，全称为Random Access Memory，即随机存取存储器，是计算机内部数据存储的核心组件，对电脑的流畅运行至关重要。
2024-08-06 16:32:25
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原创 FPGA知识基础之--clocking wizard ip核的使用以及modelsim与vivado联合仿真
IP核，全称知识产权核（Intellectual Property core），是在集成电路（IC）设计中可重用的功能模块，其存在形式通常为逻辑单元或芯片设计的可重用模块。这些模块经过预先设计、验证并具备特定的功能，可以被授权给不同的设计者使用，以加速芯片设计过程，提高设计效率，并降低开发成本。IP核是半导体产业中用于ASIC（专用集成电路）或FPGA（现场可编程门阵列）中的预先设计好的电路功能模块。它们可以被视为构建复杂芯片设计的“积木”。
2024-08-05 15:40:58
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原创 FPGA知识基础之--500ms计数器，边沿检测，按键消抖
在我们设计电路时，经常会遇到需要继续检测上升沿和下降沿的电路，因此需要对边沿继续检测。
2024-08-02 09:50:12
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原创 FPGA知识基础之--在线调试工具
FPGA（现场可编程门阵列）在线调试工具是FPGA设计和验证过程中不可或缺的一部分，它们允许开发者在FPGA实际部署到硬件之前，通过软件界面实时地观察、修改和调试FPGA内部的信号和逻辑。FPGA在线调试工具是一种通过特定接口（如JTAG）与FPGA连接，允许开发者在FPGA运行时实时访问、修改和调试其内部逻辑和信号的软件工具。这些工具通常集成在FPGA设计软件中，如Xilinx的Vivado、Intel的Quartus等，为开发者提供了强大的调试能力。
2024-07-30 10:40:47
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原创 FPGA知识基础之--触碰按键控制LED灯
本文将给予夏宇闻老师的verilog基础以及正点原子的课程来为大家带来有关触碰按键控制LED灯的相关实践
2024-07-26 17:18:28
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原创 FPGA知识基础之--按键控制LED灯项目
笔者将基于正点原子的达芬奇开发板,结合夏宇闻老师的Verilog数字系统设计教程,来记录自己学习FPGA的学习思路,希望能给与读者一些帮助自锁按键:按下之后能保持,类似于开发板的电源按键轻触摸式按键:按下就通,松开即断。
2024-07-25 23:16:56
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原创 HDLBits经典题目分享-笔者的做题思路与收获
笔者将在这个文章下更新一些HDLBits的经典题目,仅供大家参考,题号将和HDLBits保持一致,关于题目的翻译仅是笔者自己的理解,可能会造成错误,望谅解,笔者会根据每天刷的题目同步更新。
2024-07-24 09:49:54
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原创 深入浅出学FPGA--完整的流水灯设计以及仿真
本文笔者将基于正点原子的达芬奇开发板完成流水灯的学习与展现,读者在学习过程中遇到的问题均可在评论区中指出,欢迎大家批评指正.
2024-07-23 21:47:12
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原创 状态机学习之:利用三段式状态机来生成一个七分频器
本文将通过,状态机概念,状态机模型,以及状态机设计这三个部分来向大家分享一下状态机学习思路,同时以一个七分频器作为例子来简单实战
2024-07-22 21:18:16
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原创 最详细的Verilog阻塞,非阻塞赋值语句介绍--数码管控制段选信号代码
本系列将基于正点原子达芬奇开发板以及夏宇闻老师的教材书来向大家分享一下学习心得
2024-07-22 16:52:00
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原创 Verilog程序模块最详细的说明-实现流水灯
笔者将基于正点原子的达芬奇开发板,结合夏宇闻老师的Verilog数字系统设计教程,来记录自己学习FPGA的学习思路,希望能给与读者一些帮助
2024-07-22 15:02:57
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原创 FPGA知识基础之语法篇
笔者将基于正点原子的达芬奇开发板,结合夏宇闻老师的Verilog数字系统设计教程,来记录自己学习FPGA的学习思路,希望能给与读者一些帮助
2024-07-21 11:47:23
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原创 java学习小笔记二
java初学,感觉和c语言的初始架构挺像的(题外话,那个module有点像是verilog里面的)笔者今天学习了java的一些基本的小概念,例如数据类型,运算符,数据转换,同时还。
2024-07-17 09:22:49
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原创 java学习记录一
本人学习了如何在IDLE上运行一个简单的示例,具体展示如下;1:新建一个项目2:在项目中新建一个module(上诉截屏中我将module名字命名为helloworld1,原因是我项目中已经存在helloworld了,后续将统一命名为helloworld1)3:在src文件夹中建立class文件 命名为test14:编写代码System.out.println("刘亦菲");5:代码结果6:问题描述。
2024-07-16 14:15:29
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原创 javaJDK以及IDLE软件的安装
本文用于从零开始,零基础学习java和sql以适应工作要求,博主会将每日学习的进度同步到文章中,希望能给大家一些帮助,后续笔者会继续更新有关java的学习体会。
2024-07-16 10:57:53
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空空如也
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